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S波段六位高精度移相器设计

西安电子科技大学学报 2014年第2期41卷 125-129页

作者：杨小峰史江义马佩军郝跃西安电子科技大学宽禁带半导体材料与器件教育部重点实验室陕西西安710071

采用0．25μmGaAs高电子迁移率晶体管（HEMT）7-艺设计了一款六位S波段数字移相器．移相器采用高低通和全通网络结构，运用了提高相位精度和抑制级联散射的方法．移相器在0°～360°相位范围内以5．625°步进，在2．1～2．7GHz频率范围... 详细信息

采用0．25μmGaAs高电子迁移率晶体管（HEMT）7-艺设计了一款六位S波段数字移相器．移相器采用高低通和全通网络结构，运用了提高相位精度和抑制级联散射的方法．移相器在0°～360°相位范围内以5．625°步进，在2．1～2．7GHz频率范围内，最小相位均方根误差仅为1．13°．频带范围内插入损耗小于6．3dB，幅度均衡小于0．4dB，输入输出反射系数小于一10dB．

关键词：高电子迁移率晶体管数字移相器高低通相位精度级联散射抑制

面向寄存器传输级设计阶段的高效高精度功耗预测模型

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电子与信息学报 2023年第9期45卷 3166-3174页

作者：李康师瑞之陈嘉伟史江义潘伟涛王杰西安电子科技大学西安710000

功耗已成为电路设计的关键性能目标之一,现有商业工具PrimeTime PX(PTPX)的功耗预精度高,但是运行时间长,且仅面向已经生成网表的逻辑综合或者物理实现阶段。因此,降低功耗分析时间,且前移功耗预测在芯片设计中的环节变得尤为重要。该... 详细信息

功耗已成为电路设计的关键性能目标之一,现有商业工具PrimeTime PX(PTPX)的功耗预精度高,但是运行时间长,且仅面向已经生成网表的逻辑综合或者物理实现阶段。因此,降低功耗分析时间,且前移功耗预测在芯片设计中的环节变得尤为重要。该文提出一种面向千万门级专用集成电路(ASIC)的寄存器传输级(RTL)功耗预估方法,可在RTL设计阶段实现快速且准确的周期级功耗预测:根据输入信号的功耗相关性原则使用基于平滑截断绝对偏差惩罚项(SCAD)的嵌入法对输入信号自动筛选,从而解决大信号特征输入数量对预估性能的影响;通过时序对准方法对仿真波形数据进行校正,解决了sign-off级功耗与RTL级仿真波形之间的时序偏差问题,有效提升了模型预测的精度;建立了仅拥有两个卷积层和1个全连接层的浅层卷积神经网络模型,学习相邻位置和相邻时间上的信号活动与功耗的相关性信息,充分降低部署开销,使训练速度得到显著提高。该文使用开源数据集、28 nm工艺节点的3×10^(7)门级工业级芯片电路作为测试对象,实验结果表明,功耗预测结果和物理设计后PTPX分析结果相比,平均绝对百分比误差(MAPE)小于1.71%,11k时钟周期的功耗曲线预测耗时不到1.2 s。在场景交叉验证实验中,模型的预测误差小于4.5%。

关键词：功耗预估卷积神经网络寄存器传输级超大规模集成电路

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小规模频繁子电路的规律性预提取算法

计算机辅助设计与图形学学报 2010年第2期22卷 226-233页

作者：潘伟涛郝跃谢元斌史江一西安电子科技大学微电子学院宽禁带半导体材料与器件教育部重点实验室西安710071

针对数字IC规律性提取算法复杂度过高的问题,提出一种逐级对根节点进行分类的算法.通过对频繁边的直接扩展,实现了小规模频繁子电路的快速提取;利用门级电路中小规模频繁子电路与大规模频繁子电路间的结构依赖性,解决了候选子电路生成... 详细信息

针对数字IC规律性提取算法复杂度过高的问题,提出一种逐级对根节点进行分类的算法.通过对频繁边的直接扩展,实现了小规模频繁子电路的快速提取;利用门级电路中小规模频繁子电路与大规模频繁子电路间的结构依赖性,解决了候选子电路生成时根节点组合爆炸的问题.实验结果表明,该算法能够降低根节点的数量,使支持度高的候选子电路得到优先提取,并显著地减少了规律性提取的时间.

关键词：子电路同构候选子电路频繁子电路规则性指数

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数字电路并行全入度拓扑排序优化算法

计算机辅助设计与图形学学报 2016年第6期28卷 1003-1007页

作者：史江义高睿怡舒浩马佩军邸志雄西安电子科技大学宽带隙半导体技术国家重点学科实验室西安710071 西南交通大学信息科学与技术学院成都611756

针对当数字电路的时序难以满足优化目标时要进行设计迭代的问题, 通过改进产生线性序列的拓扑排序算法, 提出了并行全入度拓扑排序和数字电路并行全入度拓扑排序优化算法. 该算法通过对电路的有向图并行全入度拓扑排序, 得到电路中插入... 详细信息

针对当数字电路的时序难以满足优化目标时要进行设计迭代的问题, 通过改进产生线性序列的拓扑排序算法, 提出了并行全入度拓扑排序和数字电路并行全入度拓扑排序优化算法. 该算法通过对电路的有向图并行全入度拓扑排序, 得到电路中插入寄存器可选位置的详细信息; 然后结合得到的信息和优化目标, 直接选择流水线插入位置优化电路, 无需设计迭代. 实验结果表明, 插入同样级数流水线时, 使用文中算法优化的电路面积比重定时优化的减少20%-40%; 与经典有效重定时判定算法FEAS 相比, 该算法拥有更低的时间复杂度.

关键词：优化算法并行全入度拓扑排序有向图流水线设计

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超深亚微米高速互连的信号串扰研究

固体电子学研究与进展 2006年第4期26卷 540-544,559页

作者：史江一马晓华郝跃方建平朱志炜西安电子科技大学微电子学院西安710071

探讨了超深亚微米设计中的高速互连线串扰产生机制,提出了一种描述高速互连串扰的电容、电感耦合模型,通过频域变换方法对模型的有效性进行了理论分析。针对0.18μm工艺条件提出了该模型的测试结构,进行了流片和测量。实测结果表明,该... 详细信息

探讨了超深亚微米设计中的高速互连线串扰产生机制,提出了一种描述高速互连串扰的电容、电感耦合模型,通过频域变换方法对模型的有效性进行了理论分析。针对0.18μm工艺条件提出了该模型的测试结构,进行了流片和测量。实测结果表明,该模型能够较好地表征超深亚微米电路的高速互连串扰效应,能够定量计算片上互连线间的耦合串扰,给出不同工艺的互连线长度的优化值。

关键词：串扰互连超深亚微米信号完整性

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一种组合逻辑环转化方法

西安电子科技大学学报 2014年第1期41卷 75-80页

作者：邸志雄史江义马佩军张译袁莉郝跃许钊西安电子科技大学宽带隙半导体国家重点实验室陕西西安710071

组合逻辑环能够减少电路逻辑资源,降低电路功耗,但是其难以被静态时序分析工具分析和计算,且难以生成功能验证向量和自动测试图形向量.针对此问题,提出一种组合逻辑环转化方法,以解决硬件描述语言以及高级语言逻辑综合阶段所面临的组合... 详细信息

组合逻辑环能够减少电路逻辑资源,降低电路功耗,但是其难以被静态时序分析工具分析和计算,且难以生成功能验证向量和自动测试图形向量.针对此问题,提出一种组合逻辑环转化方法,以解决硬件描述语言以及高级语言逻辑综合阶段所面临的组合逻辑环拆分问题.不同于采用三值仿真策略的现有文献,引入了布尔可满足引擎对组合逻辑环电路进行了表征,使用静态逻辑蕴涵完成了环形电路的拆分.同时,根据环形电路的形成机理,提出了拆分组合逻辑环结构的规则,用于冗余向量优化以及非环电路的逻辑推理.实验结果表明,这种算法能够正确地拆分组合逻辑环结构,且转化时间短,转化后的电路规模小.

关键词：组合逻辑环逻辑综合 SAT引擎静态逻辑蕴涵

基于地理标志保护的保山小粒种咖啡产区品牌化研究

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热带农业科技 2023年第4期46卷 6-14页

作者：施江义王运钦保山学院经济管理学院云南保山678000 保山市政协云南保山678000

保山咖啡种植历史悠久,是云南小粒种咖啡四大产区之一,2010年“保山小粒咖啡”获国家质检总局地理标志保护,并在2021年进入首批中国100个地理标志受欧盟保护名单。然而,保山小粒种咖啡地理标志保护品牌市场认可度较低,品牌溢价效应未能... 详细信息

保山咖啡种植历史悠久,是云南小粒种咖啡四大产区之一,2010年“保山小粒咖啡”获国家质检总局地理标志保护,并在2021年进入首批中国100个地理标志受欧盟保护名单。然而,保山小粒种咖啡地理标志保护品牌市场认可度较低,品牌溢价效应未能充分发挥。为此提出推进地理标志保护品牌创建、提升地理标志保护品牌市场认可度、拓展地理标志保护产品全产业链、扩大地理标志保护产区市场影响力、加速地理标志保护产区身份标识化的建议,为提升保山小粒种咖啡地理标志产区品牌竞争力,实现地域农业产业转型和高质量发展提供参考。

关键词：小粒种咖啡地理标志品牌化保山

Recent progress of integrated circuits and optoelectronic chips

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Science China(Information Sciences) 2021年第10期64卷 103-135页

作者： Yue HAO Shuiying XIANG Genquan HAN Jincheng ZHANG Xiaohua MA Zhangming ZHU Xingxing GUO Yahui ZHANG Yanan HAN Ziwei SONG Yan LIU Ling YANG Hong ZHOU jiangyi shi Wei ZHANG Min XU Weisheng ZHAO Biao PAN Yangqi HUANG Qi LIU Yimao CAI Jian ZHU Xin OU Tiangui YOU Huaqiang WU Bin GAO Zhiyong ZHANG Guoping GUO Yonghua CHEN Yong LIU Xiangfei CHEN Chunlai XUE Xingjun WANG Lixia ZHAO Xihua ZOU Lianshan YAN Ming LI School of Microelectronics Xidian University State Key Laboratory of Integrated Service Networks Xidian University National Integrated Circuit Innovation Center School of Microelectronics Fudan University School of Integrated Circuit Science and Engineering Beihang University China Center for Information Industry Development Frontier Institute of Chip and System Fudan University Institute of Microelectronics Peking University Nanjing Electronic Devices Institute State Key Laboratory of Functional Material for Informatics Shanghai Institute of Microsystem and Information Technology Chinese Academy of Sciences Institute of Microelectronics Tsinghua University Center for Carbon-based Electronics Department of Electronics Peking University CAS Key Laboratory of Quantum Information University of Science and Technology of China CAS Center for Excellence and Synergetic Innovation Center in Quantum Information and Quantum Physics University of Science and Technology of China Origin Quantum Computing Company Limited Key Laboratory of Flexible Electronics & Institute of Advanced Materials Nanjing Tech University State Key Laboratory of Electronic Thin Films and Integrated Devices School of Optoelectronic Science and EngineeringUniversity of Electronic Science and Technology of China National Laboratory of Solid State Microstructures & College of Engineering and Applied Sciences Nanjing University State Key Laboratory on Integrated Optoelectronics Institute of Semiconductors Chinese Academy of Sciences Center of Materials Science and Optoelectronics Engineering University of Chinese Academy of Sciences State Key Laboratory of Advanced Optical Communication Systems and Networks School of Electronics Engineering and Computer Science Peking University School of Electrical and Electronic Engineering Tiangong University Center for Information Photonics and Communications School of Information Science and TechnologySouthwest Jiaotong University School of Electronic Electrical and Communication Engineering

Integrated circuits(ICs) and optoelectronic chips are the foundation stones of the modern information society. The IC industry has been driven by the so-called "Moore’s law" in the past 60 years, and now has entered the post Moore’s law era. In this paper, we review the recent progress of ICs and optoelectronic chips. The research status, technical challenges and development trend of devices, chips and integrated technologies of typical IC and optoelectronic chips are focused on. The main contents include the development law of IC and optoelectronic chip technology, the IC design and processing technology, emerging memory and chip architecture, brain-like chip structure and its mechanism, heterogeneous integration, quantum chip technology, silicon photonics chip technology, integrated microwave photonic chip, and optoelectronic hybrid integrated chip.

关键词： integrated circuit semiconductor science and technology optoelectronic device and chip photonic integrated circuit wide bandgap semiconductors silicon photonics hybrid integration quantum chip integrated microwave photonic photonic neural computing

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“研究性-项目式”复合型教学模式设计与实践

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保山学院学报 2021年第1期40卷 20-25页

作者：赵兴国施江义保山学院经济管理学院云南保山678000

积极探索复合型教学模式是推动课堂教学革命,提升应用复合型人才培养质量的重要抓手;基于问题导向、项目驱动、过程引导、协同参与和成果展示等教学设计要点,将研究性教学和项目式教学进行融合,从教学主体、内容体系、教学体系和评价体... 详细信息

积极探索复合型教学模式是推动课堂教学革命,提升应用复合型人才培养质量的重要抓手;基于问题导向、项目驱动、过程引导、协同参与和成果展示等教学设计要点,将研究性教学和项目式教学进行融合,从教学主体、内容体系、教学体系和评价体系四大模块科学设计"研究性-项目式"复合型教学模式的理论框架体系,并运用到具体的课程教学实践中。

关键词：研究性教学项目式教学复合型教学模式教学设计课程实践