检索结果-南通市图书馆

基于机器视觉的多核芯片分布式存储效率检测系统设计

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现代电子技术 2021年第3期44卷 182-186页

作者：祁宏伟集宁师范学院计算机学院内蒙古乌兰察布012000

针对传统芯片储存效率检测系统存在的检测效率低、准确性差的问题,基于机器视觉技术设计了一种新的多核芯片分布式存储效率检测系统。由背景光源、驱动电路、图像采集电路构成电路结构,配合DSP和ARM双处理器对得到的嵌入式图像进行处理... 详细信息

针对传统芯片储存效率检测系统存在的检测效率低、准确性差的问题,基于机器视觉技术设计了一种新的多核芯片分布式存储效率检测系统。由背景光源、驱动电路、图像采集电路构成电路结构,配合DSP和ARM双处理器对得到的嵌入式图像进行处理和控制。硬件结构主要由S3C6410ARM处理器与Linux操作系统构成,并设计了图像采集电路、图像处理电路、ARM外围控制电路以及VGA接口电路;软件部分通过计算分配空间占有率、空间利用率、空间块利用率和最佳利用率实现多核芯片分布式存储效率的检测。实验对比结果表明,基于机器视觉的多核芯片分布式存储效率检测系统的检测耗时较短、检测效率和准确性均较高。

关键词：机器视觉多核芯片分布式存储效率检测检测耗时准确性

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基于CNN的多核芯片低功耗验证系统设计

电子设计工程 2023年第22期31卷 125-129页

作者：王宇祝健杨何雨旻刘德宏陈军健贵州电网有限责任公司电力科学研究院贵州贵阳550002 南方电网数字电网研究院有限公司广东广州510663

针对目前设计的多核芯片低功耗验证系统验证过程损失较大、验证精度较低等问题,基于CNN设计了一种新的多核芯片低功耗验证系统。通过微处理器、写缓冲器、程序存储器和SDRAM中断控制器组成硬件结构。微处理器外部连接3个接口,通过静态... 详细信息

针对目前设计的多核芯片低功耗验证系统验证过程损失较大、验证精度较低等问题,基于CNN设计了一种新的多核芯片低功耗验证系统。通过微处理器、写缓冲器、程序存储器和SDRAM中断控制器组成硬件结构。微处理器外部连接3个接口,通过静态设计降低功耗,写缓冲器对数据进行替换。采用单片机在上电复位时利用SDRAM中断控制器控制系统电路。引入CNN技术,通过集中度验证、低功耗特征重现、验证系统建立完成系统软件操作。实验结果表明,基于CNN的多核芯片低功耗验证系统可将验证过程损失降低10%,精度提高15%。

关键词： CNN 多核芯片低功耗验证验证系统微处理器

基于改进DE算法的电力多核异构芯片能耗优化技术

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自动化技术与应用 2024年第9期43卷 85-88页

作者：辛明勇徐长宝祝健杨王宇刘德宏贵州电网有限责任公司电力科学研究院贵州贵阳550002 南方电网数字电网研究院有限公司广东广州510663

电力多核异构芯片能耗优化技术在调节处理器功耗时负担过高,为降低所需能耗,设计基于改进DE算法电力多核异构芯片能耗优化技术。计算芯片基础元件能耗,通过获取不同功耗链路特征能量值,基于改进DE算法获取芯片多核处理器调度函数与通道... 详细信息

电力多核异构芯片能耗优化技术在调节处理器功耗时负担过高,为降低所需能耗,设计基于改进DE算法电力多核异构芯片能耗优化技术。计算芯片基础元件能耗,通过获取不同功耗链路特征能量值,基于改进DE算法获取芯片多核处理器调度函数与通道序列融合模型隐藏层的神经元数量,设置位置因子平均距离,计算簇间范围内剩余能量值,建立电力数据传输系统通信能耗模型,设计电力多核异构芯片能耗优化算法。分别测试三类芯片处理器所需能耗,在不同的能耗优化技术下,实验结果可知,改进DE算法的能耗值为相同条件下的最小能耗值,可见该能耗优化方法较好。

关键词：改进DE算法能耗优化多核芯片任务内调度

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基于Pi演算的并行编程语言

吉林大学学报（工学版） 2016年第1期46卷 235-241页

作者：康辉王家琦梅芳吉林大学计算机科学与技术学院长春130012

针对传统编程语言不能便捷高效利用多核芯片计算资源的缺点,本文提出了一种并行编程语言并定义了核心语义及其运行时环境的相关算法。该语言以Pi演算为理论基础,首先根据Pi演算的基本结构定义语言的核心句法结构,然后以Pi演算中进程间... 详细信息

针对传统编程语言不能便捷高效利用多核芯片计算资源的缺点,本文提出了一种并行编程语言并定义了核心语义及其运行时环境的相关算法。该语言以Pi演算为理论基础,首先根据Pi演算的基本结构定义语言的核心句法结构,然后以Pi演算中进程间同步通信为基础定义了核心操作语义。本文给出了在并行操作语义中进程的上下文环境的定义,设计了构成运行时环境整体架构的主要数据结构及运行时环境中基于同步通信的调度算法和基于引用计数器的垃圾回收算法,根据本文定义的句法结构可以定义出高效地利用多核芯片计算资源的并行程序。

关键词：计算机软件 Pi演算编程语言并行编程多核芯片

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片内多核共享信箱的研究与设计

华中科技大学学报（自然科学版） 2009年第6期37卷 86-88,92页

作者：刘浩邹雪城王文敏吉立新华中科技大学电子科学与技术系湖北武汉430074 国家数字交换系统工程技术研究中心河南郑州450002

针对现代多CPU的微机保护装置中不同处理器之间的信息交互采用外置存储器,系统正常运行容易受到现场复杂电磁环境干扰的问题,采用了片内存储器实现多处理器之间的交互.以片内存储器为主体构建多核芯片的多层次存储结构,并采用基于消息... 详细信息

针对现代多CPU的微机保护装置中不同处理器之间的信息交互采用外置存储器,系统正常运行容易受到现场复杂电磁环境干扰的问题,采用了片内存储器实现多处理器之间的交互.以片内存储器为主体构建多核芯片的多层次存储结构,并采用基于消息机制的共享信箱完成处理器之间的信息交互.利用排队论模型详尽地分析了共享信箱中数据FIFO的性能与需求,继而推导出适用于多任务系统中数据FIFO的深度经验公式.

关键词：微机保护片内存储器多核芯片共享信箱消息通信 FIFO深度公式

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并发追踪数据流的多缓存选址算法

电子学报 2014年第11期42卷 2310-2313页

作者：高建良李欣王建新中南大学信息科学与工程学院湖南长沙410083

为了验证多核芯片的正确性,通常需要同时观测不同芯核上的多组信号.如何实时处理并发追踪中多组数据流已经成为多核芯片硅后功能验证所面临的关键挑战之一.本文提出了一种基于映射的自调节缓存选址(Map-Based Self-Regulation Location ... 详细信息

为了验证多核芯片的正确性,通常需要同时观测不同芯核上的多组信号.如何实时处理并发追踪中多组数据流已经成为多核芯片硅后功能验证所面临的关键挑战之一.本文提出了一种基于映射的自调节缓存选址(Map-Based Self-Regulation Location Selection,MSLS)算法,该算法通过优化多缓存选址,在片上网络通信带宽限制下保证了并发追踪数据流能够实时存储,同时降低了追踪数据流传输能耗.实验结果表明了该方法的有效性.

关键词：多核芯片硅后调试并发追踪多缓存选址片上网络

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HPEC中子程序级推测并行性分析

计算机工程 2020年第8期46卷 210-215,222页

作者：王欣夷王耀彬李凌杨洋卜得庆刘志勤西南科技大学计算机科学与技术学院四川绵阳621010 西南科技大学四川省军民融合研究院四川绵阳621010 四川省计算机研究院成都610041

线程级推测(TLS)技术的有效运用可提高多核芯片的硬件资源利用率,其已在多种串行应用的自动并行化工作中取得了较好效果,但目前缺乏对HPEC应用子程序级线程推测方面的有效分析。针对该问题,设计子程序级推测的剖析机制及核心数据结构,选... 详细信息

线程级推测(TLS)技术的有效运用可提高多核芯片的硬件资源利用率,其已在多种串行应用的自动并行化工作中取得了较好效果,但目前缺乏对HPEC应用子程序级线程推测方面的有效分析。针对该问题,设计子程序级推测的剖析机制及核心数据结构,选取HPEC中7个具有代表性的程序,挖掘其子程序级的最大潜在并行性,并结合线程粒度、并行覆盖率、子程序调用次数、数据依赖及源码,对程序的加速比进行分析。实验结果表明,fdfir、svd、db和ga程序的加速比在2.23~11.31,tdfir程序的加速效果最好,加速比达到221.78,对于包含多次非重度数据依赖子程序调用的应用,更适合采用子程序级TLS技术测试其并行性。

关键词：线程级推测多核芯片 HPEC基准套件数据依赖动态剖析

基于TMS320C6678的雷达信号处理系统软件设计与实现

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基于TMS320C6678的雷达信号处理系统软件设计与实现

作者：王梦玉北京理工大学

学位级别：硕士

随着雷达信号处理技术的不断发展,信号处理系统对DSP芯片提出了更高的要求,例如高效率、高实时性、低功耗等等,因此基于KeyStone架构的单片多核芯片TMS320C6678得到了广泛的应用。本文研究了TMS320C6678在雷达信号处理系统上的应用,分... 详细信息

随着雷达信号处理技术的不断发展,信号处理系统对DSP芯片提出了更高的要求,例如高效率、高实时性、低功耗等等,因此基于KeyStone架构的单片多核芯片TMS320C6678得到了广泛的应用。本文研究了TMS320C6678在雷达信号处理系统上的应用,分析了其单片多核的优势和软硬件资源,其中包括芯片接口资源、存储空间资源以及核间通信。其次,本文中阐述了雷达信号处理系统基本原理,包括脉冲压缩、动目标检测和恒虚警检测,并给出了对应的Matlab仿真结果,为接下来的软件设计与实现提供了理论基础。另外,本设计中DSP软件部分是基于TMS320C6678 SYS/BIOS平台建立的,在本文中详细的介绍了SYS/BIOS系统的构成、构建实时信号处理系统的方法以及SYS/BIOS在本设计中的具体应用。最后,设计并实现了基于TMS320C6678的雷达信号处理机系统,包括了系统程序拓扑结构/数据流、命令字流以及算法的具体实现。

关键词： TMS320C6678 多核芯片雷达信号处理 SRIO 多核通信

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一种基于Pi演算的并行编程语言

一种基于Pi演算的并行编程语言

作者：王家琦吉林大学

学位级别：硕士

随着芯片集成技术的日趋成熟，硬件受到了物理极限的约束，芯片上的元件不可能无限地缩小，当前计算机芯片的发展规律已经不再契合于摩尔定律。在此之前，晶体管成本依据摩尔定律不断缩减，以及处理器厂商在工程方面的出色表现，使得只... 详细信息

随着芯片集成技术的日趋成熟，硬件受到了物理极限的约束，芯片上的元件不可能无限地缩小，当前计算机芯片的发展规律已经不再契合于摩尔定律。在此之前，晶体管成本依据摩尔定律不断缩减，以及处理器厂商在工程方面的出色表现，使得只需要升级运行应用程序的硬件就能改进其性能。如果未来不能充分利用并行化的多核硬件资源，计算性能将永远停滞在略高于当前的水平上。为了充分利用多核计算资源，需要一种高效利用多核计算资源的编程方法，因此本文提出了一种并行编程语言PCL。描述并行问题的相关理论有诸如CSP、Actor等，但是在描述移动并发问题上Pi演算理论更具优势，并且易于做形式化分析。Pi演算是由图灵奖获得者罗宾米尔纳(RobinMilner)在1992年正式提出，是一种描述、分析移动并发系统的演算模型。Pi演算具有完善的理论体系和强大的表达能力，本文提出的并行编程语言PCL就是以Pi演算为基础的理论。因此PCL先天适用于描述并行问题，适合于并行编程。针对传统编程语言不能简单高效充分利用多核计算资源的缺点，本文提出一种可以简单高效利用多核芯片计算资源的并行编程语言PCL。PCL以Pi演算为理论基础，借鉴了Pi演算理论中的通道和进程的概念，使得PCL适用于并行编程。在定义并行进程通信时借鉴了Pi演算同步通信语义。本文的主要工作是定义了PCL并行编程语言及其运行时环境，其中运行时环境保证了PCL程序正常运行。详细工作如下。一、PCL语言模型具体包含如下工作 1.定义了PCL基本语言元素，其中和顺序计算相关的语言元素借鉴了传统编程语言中的概念;在涉及到并行通信的语言元素借鉴了Pi演算理论中主要概念（进程、通道）。 2.给出了PCL句法定义，形式化说明如何通过PCL基本元素构造出并行执行体。 3.说明了PCL进程上下文环境，其中包含定义进程在执行时需要包括的运行时信息，及给出静态计算运行时信息大小的公式。 4.提出了PCL进程之间的操作语义，定义多个并行执行的进程之间相互协作完成工作的规则，这也是运行时环境调度算法实现的依据。二、PCL运行时环境具体包含如下工作 1.提出了PCL运行时环境的整体架构，通过核心数据结构定义说明PCL运行时环境的构成。 2.定义了并行进程的调度算法，在PCL程序内并行执行进程之间的同步通信语义基础之上定义了并行进程调度算法。 3.给出了PCL运行时环境的垃圾回收机制，其中包含基于引用计数的通道和进程的垃圾回收算法。本文在完成PCL语言模型和运行时环境定义后，详细叙述了具体的实现方式。使用正则表达式定义了PCL的词法单位，使用BNF范式递归定义了进程的抽象语法树。最后通过具体的PCL程序实例说明了整个运行解析过程。最后概括起来说，本文提出的语言模型是可行的，是并行理论距离实际应用更进一步。但是仍然存在一些问题，如同步语义带来的效率问题等，这也是未来进一步研究的主要工作。

关键词： Pi演算编程语言并行计算多核芯片