改进的仲裁器PUF设计与分析
Design and Analysis of Improved Arbiter PUF作者机构：上海交通大学计算机科学与工程系上海200240 国防科学技术大学计算机学院长沙410073
出 版 物：《计算机工程》 (Computer Engineering)
年 卷 期：2010年第36卷第3期
页 面：249-250,253页
核心收录：
学科分类：08[工学] 081201[工学-计算机系统结构] 0812[工学-计算机科学与技术（可授工学、理学学位）]
基 金：国家"863"计划基金资助项目(2006AA01Z446)
主 题：仲裁器物理不可克隆函数 现场可编程逻辑阵列 D触发器
摘 要：介绍Daihyun等设计的仲裁器物理不可克隆函数(PUF)方案,指出其不足之处。在此基础上提出一种改进方案,设计并分析基于D触发器的仲裁器PUF,在FPGA平台上实现并测试该方案的性能。实验结果表明,改进方案在输出的0,1平衡性方面优于Daihyun的PUF方案。
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