检索结果-南通市图书馆

H.265帧内模式判决并行计算方法研究与实现

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小型微型计算机系统 2018年第11期39卷 2523-2527页

作者：李申柴志雷严伟夏珺赵建斌江南大学物联网工程学院江苏无锡214122 数学工程与先进计算国家重点实验室江苏无锡214125 北京大学软件与微电子学院北京102600

针对H.265帧内编码算法编码速度慢的问题,基于现场可编程逻辑门阵列(FPGA)设计了一种并行帧内模式判决架构.首先通过理论推导,证明可以将多层次多尺度编码块的模式判决问题转化为单一层次多个小尺度编码块模式判决的叠加问题;其次,在编... 详细信息

针对H.265帧内编码算法编码速度慢的问题,基于现场可编程逻辑门阵列(FPGA)设计了一种并行帧内模式判决架构.首先通过理论推导,证明可以将多层次多尺度编码块的模式判决问题转化为单一层次多个小尺度编码块模式判决的叠加问题;其次,在编码块内部通过细粒度并行实现快速模式判决,在编码块之间通过窗口流水方式实现快速处理;最终在FPGA上设计并实现了该帧内快速模式判决架构.实验结果表明,本文算法最高可达到93.6x的加速比,且编码后的视频质量损失较小(PSNR平均降低0.71dB).

关键词：视频编码 FPGA 模式判决编码块叠加细粒度并行

功率VDMOS(带氮化硅结构)的UIS失效改善

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电子与封装 2018年第8期18卷 44-48页

作者：冯超王振宇郝志杰华润上华科技有限公司江苏无锡214000 北京大学软件与微电子学院北京102600

功率VDMOS器件是最为普遍的开关器件。而UIS发生过程是指功率VDMOS器件在整个系统中所能承受的最严峻电应力以及热应力的考验过程,所以抵抗UIS失效能力成为衡量其可靠性的重要指标。针对UIS的测试方法和机理做了简单的介绍,同时针对某... 详细信息

功率VDMOS器件是最为普遍的开关器件。而UIS发生过程是指功率VDMOS器件在整个系统中所能承受的最严峻电应力以及热应力的考验过程,所以抵抗UIS失效能力成为衡量其可靠性的重要指标。针对UIS的测试方法和机理做了简单的介绍,同时针对某款功率VDMOS产品的UIS改善方案进行了详细的描述。

关键词： DMOS UIS 带氮化硅结构

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二进制代码测试覆盖率评估系统设计与实现

指挥信息系统与技术 2015年第6期6卷 13-17页

作者：张垚张超容林腾董芳泉江南计算技术研究所江苏无锡214083 北京大学软件与微电子学院江苏无锡214083

针对模糊测试终止时机问题,提出了二进制代码测试覆盖率评估方法,通过二进制代码的静态与执行轨迹动态两种分析,可评估模糊测试对目标程序二进制代码的测试覆盖,从而设计并实现了二进制测试覆盖率评估系统。该系统给出了测试用例集合对... 详细信息

针对模糊测试终止时机问题,提出了二进制代码测试覆盖率评估方法,通过二进制代码的静态与执行轨迹动态两种分析,可评估模糊测试对目标程序二进制代码的测试覆盖,从而设计并实现了二进制测试覆盖率评估系统。该系统给出了测试用例集合对目标可执行程序二进制基本块及二进制指令集的覆盖率和路径覆盖数指标,以度量测试用例质量。

关键词：模糊测试二进制代码代码覆盖率测试用例集软件测试

基于FPGA的深度学习目标检测系统的设计与实现

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电子技术应用 2019年第8期45卷 40-43,47页

作者：陈辰严伟夏珺柴志雷江南大学物联网工程学院江苏无锡214122 北京大学软件与微电子学院北京102600

针对当前深度学习目标检测算法计算复杂度高和内存需求大等问题,设计并实现了一种基于FPGA的深度学习目标检测系统。设计对应YOLOv2-Tiny目标检测算法的硬件加速器,对加速器各模块的处理时延建模,给出卷积计算模块的详细设计。实验结果... 详细信息

针对当前深度学习目标检测算法计算复杂度高和内存需求大等问题,设计并实现了一种基于FPGA的深度学习目标检测系统。设计对应YOLOv2-Tiny目标检测算法的硬件加速器,对加速器各模块的处理时延建模,给出卷积计算模块的详细设计。实验结果表明,与CPU相比,CPU+FPGA的异构系统是双核ARM-A9能效的67.5倍,Xeon的94.6倍;速度是双核ARM-A9的84.4倍,Xeon的5.5倍左右。并且,当前设计在性能上超过之前的工作。

关键词：深度学习目标检测 FPGA 硬件加速器

基于FPGA的HEVC感兴趣区域编码算法研究与设计

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电子技术应用 2018年第7期44卷 52-55页

作者：李申严伟夏珺崔正东柴志雷江南大学物联网工程学院江苏无锡214122 北京大学软件与微电子学院北京102600

为了在保证视频质量的前提下降低视频编码码率,基于FPGA并行处理和HEVC视频分块编码的特点,提出一种基于块匹配的高斯背景建模-感兴趣区域(ROI)映射算法,并用于HEVC视频编码。通过基于块匹配的高斯方法建立背景帧后,利用SAD判别准则对... 详细信息

为了在保证视频质量的前提下降低视频编码码率,基于FPGA并行处理和HEVC视频分块编码的特点,提出一种基于块匹配的高斯背景建模-感兴趣区域(ROI)映射算法,并用于HEVC视频编码。通过基于块匹配的高斯方法建立背景帧后,利用SAD判别准则对视频帧的编码块进行二分类,进而映射到编码树单元(CTU);然后根据率失真特性对ROI区域和非ROI区域的量化参数进行自适应调整,并进入后续的HEVC编码过程。实验结果表明,在FPGA平台上该算法运行速度高达22 fps@1080 p;建模后提取的ROI映射CTU区域变质量编码可得到平均约10%的码率节省,视频质量保持稳定。

关键词：感兴趣区域提取背景建模 FPGA 变质量视频编码 HEVC

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粮食主产区农民收入结构区域差异分析

江苏农业科学 2017年第2期45卷 289-292页

作者：王娜高瑛金兴李向菲江南大学商学院江苏无锡214122 南京信息工程大学公共管理学院江苏南京210000 北京大学软件与微电子学院北京100000 江南大学食品学院江苏无锡214122

粮食安全是关乎国计民生的热点问题,而增加种粮农户收入、提高种粮农户的生产积极性是确保粮食安全供给的关键。利用泰尔指数对我国粮食主产区农民收入区域差异变化进行测度分析。结果表明,家庭经营性收入和工资性收入仍是主产区农民收... 详细信息

粮食安全是关乎国计民生的热点问题,而增加种粮农户收入、提高种粮农户的生产积极性是确保粮食安全供给的关键。利用泰尔指数对我国粮食主产区农民收入区域差异变化进行测度分析。结果表明,家庭经营性收入和工资性收入仍是主产区农民收入的主要来源;区域总泰尔指数较小,但自2008年以来有上升趋势,主产区内农民收入相对均衡,微小的波动主要源于财产性收入和转移性收入;区域间泰尔指数较小,呈下降趋势;各区域内农民收入和各收入来源差异呈现不同走势。并针对如何提高粮食主产区农民收入、缩小区域内农民收入差异、促进主产区农民粮食生产保障粮食安全等提出政策建议。

关键词：粮食主产区区域差异泰尔指数农民收入

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粮食主产区粮食生产要素利用效率分析

江苏农业科学 2017年第7期45卷 338-342页

作者：金兴李向菲余华彬高瑛王娜北京大学软件与微电子学院北京102600 江南大学食品学院江苏无锡214122 南京信息工程大学公共管理学院江苏南京210044 江南大学商学院江苏无锡214122

用数据包络分析(DEA)对粮食主产区主要粮食作物(小麦、水稻)生产投入要素技术效率进行宏观分析,并对粮食主产区农户农业生产行为特征和认知进行微观评价。结果表明,不同省份各粮食作物生产技术效率差异较大,大多数省份均技术效率无效,... 详细信息

用数据包络分析(DEA)对粮食主产区主要粮食作物(小麦、水稻)生产投入要素技术效率进行宏观分析,并对粮食主产区农户农业生产行为特征和认知进行微观评价。结果表明,不同省份各粮食作物生产技术效率差异较大,大多数省份均技术效率无效,粮食产量较大的省份,技术效率一般较小,单位耕地的要素调整量也较大。受访农民年龄偏高,受教育水平较低,许多农户对正确使用农业生产要素缺乏了解。基于研究结果,为提高粮食生产投入要素转化效率提出相应的政策建议。

关键词：数据包络分析技术效率农户行为可持续农业环境保护

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改进搜索引擎及其数据结构的设计

情报科学 2012年第2期30卷 200-205页

作者：郑志宏徐卓君文红郑志高吉林化工学院理学院吉林吉林132022 吉林大学通信工程学院吉林长春130012 湖北大学商学院湖北武汉430067 北京大学软件与微电子学院江苏无锡214125

针对传统搜索引擎在搜索过程中产生的临时文件多、占用磁盘空间大的问题,本文改进了搜索引擎的数据结构,采用索引压缩技术减少了临时文件,提高了检索效率。

关键词：搜索引擎 Web检索索引词中文分词

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ΣΔ微加速度计中基于脉宽调制的力反馈回路

传感技术学报 2013年第12期26卷 1704-1709页

作者：陶呈瑶邓康发中国科学院地质与地球物理研究所/海外高层次人才创新创业基地北京100029 中国科学院大学北京100049 北京大学微电子学研究院微米/纳米加工技术国家级重点实验室北京100871

针对微加速度计接口电路的Sigma-Delta(ΣΔ)数字反馈系统,提出了一种基于脉宽调制(PWM)的力反馈回路:利用模拟低通滤波器将PWM波解调成模拟输出信号,具有滤波和数模转换功能。首先建立微加速度计ΣΔ闭环反馈系统的Simulink模型并进行... 详细信息

针对微加速度计接口电路的Sigma-Delta(ΣΔ)数字反馈系统,提出了一种基于脉宽调制(PWM)的力反馈回路:利用模拟低通滤波器将PWM波解调成模拟输出信号,具有滤波和数模转换功能。首先建立微加速度计ΣΔ闭环反馈系统的Simulink模型并进行了系统级仿真。之后采用Filter Solutions滤波器设计软件确定三阶低通巴特沃斯滤波器,并采用Pspice仿真软件进行电路级仿真。最后将制作的PCB版电路进行测试:PWM波通过力反馈回路能还原成高保真度的模拟信号,输出信号和输入信号的频率相对误差小于0.36%,等效DAC分辨率为8 bit。试验表明,此方案结构简单、成本低,能以较低电路复杂度实现高精度的模拟信号输出。

关键词：微加速度计接口电路 ∑△ 数模转换器脉宽调制