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Enhanced offset averaging Technique for Flash ADC Design

Tsinghua Science and Technology 2011年第3期16卷 285-289页

作者： Siqiang FAN He TANG Hui ZHAO Xin WANG Albert WANG Bin ZHAO Gary G ZHANG Freescale Semiconductor Inc Irvine CA 92618 USA Department of Electrical Engineering University of California Riverside CA 92521USA Skyworks Solutions Inc.Irvine CA 92617 USA

This paper presents a new combined AC/DC-coupled output averaging technique for input amplifier design of flash analog-to-digital converters （ADC）. The new offset averaging design technique takes full advantage of traditional DC-coupled resistance averaging and AC-coupled capacitance averaging techniques to minimize offset-induced ADC nonlinearities. Circuit analysis allows selection of optimum resistance and capacitance averaging factors to achieve maximum offset reduction in ADC designs. The new averaging method is verified in designing a 4 bit 1 Gs/s flash ADC that is implemented in foundry 0.13 μm CMOS technology.

关键词： analog-to-digital converter flash analog-to-digital converters (ADC) integrated circuit (IC) offset averaging resistor averaging capacitor averaging

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A 2-GS/s 6-bit self-calibrated flash ADC

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Journal of Semiconductors 2010年第9期31卷 129-133页

作者：张有涛李晓鹏张敏刘奡陈辰 National Key Laboratory of Monolithic Integrated Circuits and Modules Nanjing Electronic Devices Institute Nanjing Electronic Devices Institute

A single channel 2-GS/s 6-bit ADC with cascade resistive averaging and self foreground calibration is demonstrated in 0.18-μm *** calibration method based on DAC trimming improves the linearity and dynamic performance *** peak DNL and INL are measured as 0.34 and 0.22 LSB,*** SNDR and SFDR have achieved 36.5 and 45.9 dB,respectively,with 1.22 MHz input signal and 2 GS/*** proposed ADC,including on-chip track-and-hold amplifiers and clock buffers,consumes 570 mW from a single 1.8 V supply while operating at 2 GS/s.

关键词： analog-to-digital conversion offset averaging flash interpolation calibration

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