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面向rapidio控制器与片上网络的转换接口设计

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集成电路与嵌入式系统 2024年第3期24卷 40-45页

作者：鞠虎田青高营韩玉洁周颖陈俊如中国电子科技集团公司第五十八研究所无锡214072

随着嵌入式处理器性能的不断提升,传统的并行总线互联方案已不能满足日益增长的带宽需求。rapidio技术缓解了传统互联总线性能缓慢增长和处理器性能高速发展之间的矛盾,同时,片上网络也已成为多核体系结构中最常用的互联结构。为了实现... 详细信息

随着嵌入式处理器性能的不断提升,传统的并行总线互联方案已不能满足日益增长的带宽需求。rapidio技术缓解了传统互联总线性能缓慢增长和处理器性能高速发展之间的矛盾,同时,片上网络也已成为多核体系结构中最常用的互联结构。为了实现两者之间的数据交互,设计了一种面向rapidio控制器与片上网络的转换接口,可实现rapidio控制器的AXI协议到片上网络内部包传输的转换,满足rapidio设备读/写操作的需求。仿真结果表明,转换接口功能正确、完整,符合设计要求。

关键词： rapidio 片上网络转换接口

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一种基于rapidio的虚通道管理方法

集成电路与嵌入式系统 2024年第4期24卷 93-96页

作者：费霞高逸龙中国电子科技集团公司第十研究所成都610036

分析嵌入式系统通信需求及rapidio总线通信特点,融合机架内rapidio网络管理技术,提出了一种适用于大规模嵌入式异构平台的rapidio虚通道管理方法,利用Zynq芯片作为管理节点,建立rapidio虚通道。为资源池系统提供了机架内节点高速通信的... 详细信息

分析嵌入式系统通信需求及rapidio总线通信特点,融合机架内rapidio网络管理技术,提出了一种适用于大规模嵌入式异构平台的rapidio虚通道管理方法,利用Zynq芯片作为管理节点,建立rapidio虚通道。为资源池系统提供了机架内节点高速通信的能力,且为嵌入式系统的通信扩展提供了强力支撑。

关键词：网络管理 Zynq 嵌入式平台通信 rapidio

一种基于rapidio协议的光纤总线硬件架构设计与分析

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兵工学报 2012年第12期33卷 1480-1484页

作者：千应庆王晓锋劳力徐润华蒋良荭南京理工大学机械工程学院江苏南京210094

研究了一种基于rapidio协议的光纤总线,该总线采用多个节点对一个交换板的星型拓补结构,通过高性能、抗干扰的光纤通道,将节点与交换板的短距离(十几厘米)的电互连拓展成远距离(几十米)的光纤互连,采用交换板背板级联和光纤级联两种方... 详细信息

研究了一种基于rapidio协议的光纤总线,该总线采用多个节点对一个交换板的星型拓补结构,通过高性能、抗干扰的光纤通道,将节点与交换板的短距离(十几厘米)的电互连拓展成远距离(几十米)的光纤互连,采用交换板背板级联和光纤级联两种方式实现总线节点的扩展。重点设计了节点、交换板、后I/O板的硬件架构,并对照rapidio协议,分析了传输过程中时延开销对传输性能的影响,提出了采用计算时延保证传输性能的设计方法,从而计算得到光纤的极限长度。在初步工程设计阶段,测试了串行rapidio数据通过光纤发送和接收电路后的波形参数,对照眼图模板验证其性能良好。

关键词：通信技术 rapidio 光纤总线传输时延

基于FPGA+DSP架构的rapidio接口硬件技术与实现

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船电技术 2022年第1期42卷 49-53页

作者：余晖冬龚昊龑王书磊中国人民解放军92145部队上海200080

rapidio传输效率高、系统成本低、系统稳定性好,在高性能嵌入式系统中得到了广泛的应用。传统的rapidio总线致力于解决器件间、板间和子系统间等同一机箱内或同一系统内的背板互连问题。为使多个嵌入式系统互联保持总线的一致性,并能在... 详细信息

rapidio传输效率高、系统成本低、系统稳定性好,在高性能嵌入式系统中得到了广泛的应用。传统的rapidio总线致力于解决器件间、板间和子系统间等同一机箱内或同一系统内的背板互连问题。为使多个嵌入式系统互联保持总线的一致性,并能在机箱间使用rapidio总线,需要对rapidio总线的使用范围进行扩展。本文提出了基于FPGA+DSP架构的通用rapidio接口硬件实现方案。通过引入光电模块,将rapidio的LVDS信号转换成光信号,在机箱间传输信号,成功拓展了rapidio传输距离,解决了rapidio传输距离局限于一个机箱内的问题主要从硬件方面对rapidio接口实现方案进行阐述。最后搭建实验平台对所实现的rapidio总线进行了连通性测试,证明了此种方案的可行性。

关键词： rapidio 嵌入式互连 FPGA DSP

信号处理系统中rapidio网络配置管理方法研究

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航空计算技术 2023年第3期53卷 112-115页

作者：吴姣郝玉锴樊超航空工业西安航空计算技术研究所陕西西安710000

随着航电系统一体化平台的发展,航电系统中的rapidio多采用串行I/O和基于交换的拓扑结构。设计了一种基于rapidio交换网络的信号处理系统,采用PowerPC8548E作为I^(2)C的主设备完成rapidio交换设备的上电初始化,依据系统的rapidio网络配... 详细信息

随着航电系统一体化平台的发展,航电系统中的rapidio多采用串行I/O和基于交换的拓扑结构。设计了一种基于rapidio交换网络的信号处理系统,采用PowerPC8548E作为I^(2)C的主设备完成rapidio交换设备的上电初始化,依据系统的rapidio网络配置,利用rapidio维护操作实现对网络上设备枚举和路由配置等功能。这种配置方法灵活,性能优良,不仅能满足系统的应用需求,同时使系统在可重构性、可扩展性、可维护性等性能指标上均获得了显著的改善。

关键词： rapidio 交换网络信号处理系统 I^(2)C 维护操作

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一种机载rapidio系统的国产化设计

航空计算技术 2023年第3期53卷 107-111页

作者：高业文西南电子技术研究所四川成都610000

为了满足机载嵌入式系统自主可控要求,针对全国产化软硬件的差异,提出了一种基于rapidio交换网络的软件通信方法,解决了rapidio网络管理与通信中间件的国产化适配问题,构建了与进口软硬件一致的应用软件运行环境,最大程度地支持应用软... 详细信息

为了满足机载嵌入式系统自主可控要求,针对全国产化软硬件的差异,提出了一种基于rapidio交换网络的软件通信方法,解决了rapidio网络管理与通信中间件的国产化适配问题,构建了与进口软硬件一致的应用软件运行环境,最大程度地支持应用软件的可移植、可重用。测试验证与工程应用表明,所提方法支持应用软件从进口芯片到国产化替代的平滑迁移,基于rapidio总线的通信服务与进口件功能一致,能够有效提升国产化系统的集成效率。

关键词：航电系统国产化芯片 rapidio 网络管理通信中间件

基于RDMA的rapidio用户态通信接口实现

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计算机科学 2010年第6期37卷 293-296页

作者：冀映辉张建东蔡炜蔡惠智中国科学院声学研究所北京100190 中国科学院研究生院物理科学学院北京100191

作为一款高性能的嵌入式互联协议,rapidio支持RDMA操作以获得高性能。目前,针对rapidio通信接口只有以太网模拟器,这种实现机制限制了rapidio通信性能的发挥。参考国内外基于RDMA的通信协议实现方法,并结合rapidio互联协议的特点,提出... 详细信息

作为一款高性能的嵌入式互联协议,rapidio支持RDMA操作以获得高性能。目前,针对rapidio通信接口只有以太网模拟器,这种实现机制限制了rapidio通信性能的发挥。参考国内外基于RDMA的通信协议实现方法,并结合rapidio互联协议的特点,提出了一套基于RDMA技术的rapidio用户态通信接口实现方法。在此基础上,验证了通信接口的性能并对实现方案进行了多种优化。经比较,实现的rapidio通信接口数据吞吐量是目前所有已知的rapidio通信接口中最高的。

关键词： rapidio 远程直接内存存取用户态通信接口并行信号处理系统

一种低时延的串行rapidio端点设计方案(英文)

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北京大学学报（自然科学版） 2013年第4期49卷 570-578页

作者：吴峰锋贾嵩王源张大成北京大学微电子研究院器件与线路重点实验室北京100871

提出一种可兼容V1.3版本规范的低时延端点实现方案。在该方案中,输出和输入路径上的多数模块工作在直通模式以产生稳定的低时延。对于事务接口,请求和响应可以通过不同的用户定义端口输入并共享传输路径,而且同时发起的事务能在安全的... 详细信息

提出一种可兼容V1.3版本规范的低时延端点实现方案。在该方案中,输出和输入路径上的多数模块工作在直通模式以产生稳定的低时延。对于事务接口,请求和响应可以通过不同的用户定义端口输入并共享传输路径,而且同时发起的事务能在安全的仲裁机制下保持有序传送。为了防止无效的数据传输,废弃的事务包将会被改进的4队列式缓冲模块撤销。对于串行物理接口,1x/4x链路能为事务包和控制符号提供可靠的数据传送,并实现流量控制、错误检测及恢复等关键的链路管理功能。与参考设计相比,此方案能获得更低的传输时延和更高的数据吞吐率。此方案的功能和性能已通过FPGA平台的验证,因此能满足下一代高速嵌入式互连的应用需求。

关键词： rapidio SRIO端点嵌入式互连串行物理层低时延

一种基于rapidio通信协议的64b/67b码组边界锁定设计

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中国集成电路 2022年第5期31卷 37-41页

作者：周韧胡孔阳顾大晔安徽芯纪元科技有限公司

本文介绍了基于rapidio通信协议的64b/67b编码技术以及67b码组的概念,并针对码组边界的锁定难题提出了一种易于实现的逻辑设计,该设计实现了将由底层Serdes接收到的乱序67bit数据重新组合,从而锁定正确的67bit数据边界的功能。使用veri... 详细信息

本文介绍了基于rapidio通信协议的64b/67b编码技术以及67b码组的概念,并针对码组边界的锁定难题提出了一种易于实现的逻辑设计,该设计实现了将由底层Serdes接收到的乱序67bit数据重新组合,从而锁定正确的67bit数据边界的功能。使用verilog硬件描述语言实现设计,硬件功能通过仿真编译工具验证。

关键词： rapidio 64b/67b 码组边界