检索结果-南通市图书馆

扬州教育学院学报 2006年第3期24卷 52-54页

作者：时为扬州教育学院物理系江苏扬州225002

应用modelsim仿真程序,对实现UART功能的Verilog HDL程序进行了仿真验证,并给出了仿真的结果。

关键词： modelsim仿真硬件描述语言 Verilog UART

基于FPGA的MPSK信号实时解调系统的设计与实现

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电子科技 2024年

作者：张诏儒刘生刘世刚中原工学院电子信息学院

针对BPSK(Binary Phase Shift Keying)、QPSK(Quadrature Phase Shift Keying)、PI/4-QPSK(PI/4-Quadrature Phase Shift Keying)、OQPSK(Offset Quadrature Phase Shift Keying)、8PSK(8 Phase Shift Keying)这5种相移键控信号，文中提出了一种基于FPGA(Field Programmable Gate Array)的参数可配置的实时在线解调系统设计算法。采用相同预处理结构对不同配置参数、不同调制方式的中频信号进行处理，根据信号的不同特性分别进行解调，得到星座数据以及解调码元。在MATLAB平台上完成了算法中各模块的定点化仿真，在Vivado平台上使用Verilog语言开发了FPGA算法，并结合modelsim软件针对各个模块以及总工程进行仿真验证。使用罗德与施瓦茨公司SMBV100B型号的信号发生器产生了5种调制类型的信号，使用ADRV9009对信号进行采集，使用AMD公司7系列的xc7vx690tffg1157-2芯片进行板载测试。测试结果表明，该解调系统能够完成5种MPSK(Multiple Phase Shift Keying)信号的解调功能。相较于传统设计结构，所提算法结构节省了硬件资源，具有重要的工程参考价值。

关键词：多进制相移键控中频信号实时解调动态配置 Verilog FPGA MATLAB定点化 modelsim仿真

基于FPGA的GPS接收机相关器技术研究与实现

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系统仿真学报 2011年第7期23卷 1513-1517,1521页

作者：胡辉袁超吴超高明华华东交通大学信息工程学院南昌330013 中国科学院光电研究院北京100094

利用EDA技术和FPGA技术,研制出具有自主知识产权基于FPGA的GPS相关器。采用本地产生C/A码的超前、即时、滞后码与输入信号进行并行相关,并得到预检测值用于捕获GPS信号;重点设计载波NCO相位、载波周数、码相位、历元计数等测量数据产生... 详细信息

利用EDA技术和FPGA技术,研制出具有自主知识产权基于FPGA的GPS相关器。采用本地产生C/A码的超前、即时、滞后码与输入信号进行并行相关,并得到预检测值用于捕获GPS信号;重点设计载波NCO相位、载波周数、码相位、历元计数等测量数据产生模块,含该模块的GPS相关器可用于实现导航型和测量型接收机;阐述了GPS相关器各个模块的详细设计,并用VHDL在FPGA中实现了其全部设计。在modelsim下进行功能仿真和时序仿真,仿真正确后下载到Xilinx Virtex-II Pro开发板中进行验证。运行结果表明设计的GPS相关器与微处理器配合可以完成GPS信号的基带信号处理。

关键词： GPS 相关器 FPGA ISE modelsim仿真

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GPS接收机相关器技术研究及FPGA实现

系统仿真学报 2008年第13期20卷 3582-3585页

作者：王尔申张淑芳胡青姜毅孙晓文大连海事大学信息科学技术学院辽宁大连116026

GPS接收机中的相关器设计是GPS接收机设计的一个关键技术之一。阐述了GPS相关器的工作原理和结构,对构成相关器的各个模块进行了详细的理论分析,利用本地产生的C/A码的超前、即时、滞后码与输入信号进行并行相关,提高了捕获的速度和精度... 详细信息

GPS接收机中的相关器设计是GPS接收机设计的一个关键技术之一。阐述了GPS相关器的工作原理和结构,对构成相关器的各个模块进行了详细的理论分析,利用本地产生的C/A码的超前、即时、滞后码与输入信号进行并行相关,提高了捕获的速度和精度,并用verilog硬件描述语言在FPGA中实现了GPS相关器的全部设计。设计中首先在modelsim下进行功能仿真,然后进行时序仿真,仿真通过后下载到Xilinx VirtexTM-II Pro开发板中进行验证。运行结果表明设计的相关器工作正常,性能可靠,与微处理器配合可以完成GPS信号的捕获和跟踪。

关键词： GPS 相关器 FPGA 并行相关 modelsim仿真

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海洋石油地震勘探拖缆模拟系统设计与实现

核电子学与探测技术 2012年第8期32卷 937-941页

作者：曹桂平宋克柱杨俊峰王砚方中国科学院核探测技术和核电子学重点实验室合肥230026 中国科技大学近代物理系快电子实验室合肥230026

大容量数据模拟系统一方面用于对现有系统进行极端性测试,揭露被测试系统存在的问题,从而使得系统更加完善;另一方面为被测试系统应用于更加严格条件下的工作做前导性试验和准备。论文基于海上石油勘探实际应用中的一个拖缆模拟系统,详... 详细信息

大容量数据模拟系统一方面用于对现有系统进行极端性测试,揭露被测试系统存在的问题,从而使得系统更加完善;另一方面为被测试系统应用于更加严格条件下的工作做前导性试验和准备。论文基于海上石油勘探实际应用中的一个拖缆模拟系统,详细介绍了基于FPGA的大容量数据模拟系统的设计思想和基本实现,可作为此类应用的设计典范,提出的结构框架也可作为数据采集类应用的设计参考模型。

关键词：现场可编程门陈列数据模拟 modelsim仿真

基于Altera FPGA的部分串行FIR滤波器

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沈阳工业大学学报 2009年第5期31卷 577-581页

作者：郭雨梅陈曦沈阳工业大学信息科学与工程学院沈阳110870

为了设计资源消耗少、性能优良、通用性强的FIR滤波器,提出一种利用Altera CYCLONEIII系列FPGA内部M9KRAM、硬件乘法器和逻辑单元构建部分串行FIR滤波器的设计思想.与完全串行结构相比,成倍提高了运算速度,减少了运算延迟;与完全并行结... 详细信息

为了设计资源消耗少、性能优良、通用性强的FIR滤波器,提出一种利用Altera CYCLONEIII系列FPGA内部M9KRAM、硬件乘法器和逻辑单元构建部分串行FIR滤波器的设计思想.与完全串行结构相比,成倍提高了运算速度,减少了运算延迟;与完全并行结构相比,减少了逻辑单元的消耗.利用MATLAB中的fdatool工具设计FIR滤波器,并对系数进行量化;利用Quartus软件编译,并通过modelsim软件仿真testbench中响应的输入、输出量.仿真结果验证了该设计方法的正确性,所设计的部分串行FIR滤波器具有资源消耗少、运算速度快等特点.

关键词：现场可编程逻辑阵列 FIR滤波器部分串行 fdatool工具 M9KRAM模块硬件乘法器 modelsim仿真低延迟

基于FPGA的SPI接口Flash控制器设计及其在存储配置数据中的应用

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吉林大学学报（理学版） 2014年第5期52卷 1022-1026页

作者：赵庆平李素文杜伟宁姜恩华淮北师范大学物理与电子信息学院安徽淮北235000 空军航空大学飞行训练基地长春130062

针对现场可编程门阵列(FPGA)丰富的逻辑资源及产生精确时序的能力,给出一种基于FPGA的SPI控制器的设计方法.可方便地对SPI flash进行读写、擦除等操作,从而能快速、准确地存储数据.在SPI控制器设计过程中使用modelsim进行仿真验证,并用V... 详细信息

针对现场可编程门阵列(FPGA)丰富的逻辑资源及产生精确时序的能力,给出一种基于FPGA的SPI控制器的设计方法.可方便地对SPI flash进行读写、擦除等操作,从而能快速、准确地存储数据.在SPI控制器设计过程中使用modelsim进行仿真验证,并用VHDL硬件描述语言进行编程,下载到FPGA开发板上进行测试,对SPI接口flash进行操作,证明了系统设计方法的正确性和可靠性,该方法对flash存储控制系统的设计具有普遍适用性,实现了对以FPGA为控制核心的系统数据长时间存储.

关键词：串行外设接口控制器现场可编程门阵列 VHDL设计 modelsim仿真

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基于混沌映射的分组密码算法

计算机工程 2011年第16期37卷 120-122页

作者：韩睿赵耿刘山鸣赵菲北京电子科技学院研究生处北京100070

提出一种新的混沌分组密码算法。该算法基于扩展Feistel结构将128 bit明文加密为128 bit密文。轮函数中的S盒由Logistic混沌映射产生,算法密钥由128 bit的初始密钥通过Cubic映射迭代生成。采用硬件描述语言VerilogHDL设计实现该算法,并... 详细信息

提出一种新的混沌分组密码算法。该算法基于扩展Feistel结构将128 bit明文加密为128 bit密文。轮函数中的S盒由Logistic混沌映射产生,算法密钥由128 bit的初始密钥通过Cubic映射迭代生成。采用硬件描述语言VerilogHDL设计实现该算法,并用modelsim对加解密过程进行仿真,实验结果证明其具有高灵敏度的S盒,密钥空间大,混乱和扩散性能好。

关键词：混沌分组密码扩展Feistel结构 S盒混沌映射 modelsim仿真

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基于FPGA的IP承载网损伤仪设计

电视技术 2013年第3期37卷 201-204页

作者：李星张治中重庆邮电大学通信网与测试技术重点实验室重庆400065

针对IP承载网的结构和技术特点,结合目前网络性能测试的现状和需求,提出了一种基于FPGA的IP承载网损伤仪的系统框架,研究了在FPGA上实现模拟丢包率的方法,阐述了损伤仪硬件模块的设计思想。该方案在仿真测试上通过验证,有着良好的应用... 详细信息

针对IP承载网的结构和技术特点,结合目前网络性能测试的现状和需求,提出了一种基于FPGA的IP承载网损伤仪的系统框架,研究了在FPGA上实现模拟丢包率的方法,阐述了损伤仪硬件模块的设计思想。该方案在仿真测试上通过验证,有着良好的应用前景。

关键词： IP承载网 FPGA 损伤仪正态分布 modelsim仿真

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基于FPGA的粒子滤波算法研究与实现

微电子学与计算机 2015年第8期32卷 58-61,66页

作者：王尔申范云飞庞涛沈阳航空航天大学电子信息工程学院辽宁沈阳110136 北京航空航天大学电子信息工程学院北京100191

粒子滤波算法在处理非线性、非高斯系统方面有明显的优势,但计算量大限制了其实时性的应用.针对这一问题,提出利用FPGA的高速运算和并行处理的特点实现粒子滤波算法.采用模块化设计,用verilog硬件描述语言在FPGA中实现了粒子滤波算法的... 详细信息

粒子滤波算法在处理非线性、非高斯系统方面有明显的优势,但计算量大限制了其实时性的应用.针对这一问题,提出利用FPGA的高速运算和并行处理的特点实现粒子滤波算法.采用模块化设计,用verilog硬件描述语言在FPGA中实现了粒子滤波算法的各个模块的设计.设计中利用modelsim进行功能仿真和时序仿真验证.仿真结果表明:设计的粒子滤波算法各个模块工作正常,可用于非线性、非高斯系统的粒子滤波实现中.这对粒子滤波的硬件实现方面具有一定的参考价值.

关键词：粒子滤波 FPGA modelsim仿真硬件实现