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A 434/868 MHz CMOS low-iF receiver with i/q imbalance calibration for SRDs application

Journal of Semiconductors 2009年第3期30卷 97-103页

作者：李娟赵冯叶国敬洪志良 State Key Laboratory of ASiC & System Fudan University

A receiver for SRDs implemented by the 0.35μm CMOS process is presented. The receiver, together with the ADC, power amplifier （PA）, frequency synthesizer and digital baseband has been integrated into a single chip solution. Low cost and low power requirements are met by optimizing the receiver architecture and circuit topology. A simple mixed-signal mode i/q imbalance calibration circuit is proposed to enhance the iRR （image rejection ratio） so as to raise the BER. From a single 3 V power supply, the receiver consumes 5.9 mA. The measurement result shows that the receiver achieves reference sensitivity of-60 dBm and a control gain of 60 dB. The S11 reaches -20 dB at 433 MHz and -10 dB at 868 MHz without off-chip impedance match network. The die area is only 2 mm^2 including the bias circuit.

关键词： short range device low-power low-cost receiver i/q imbalance calibration

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