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基于自适应重排的低功耗地址总线编码

西安交通大学学报 2006年第4期40卷 394-397页

作者：孙海邵志标西安交通大学电子与信息工程学院西安710049

为了降低大负载地址总线的功耗,提出了一种新的低功耗自适应偏移量总线编码方法.该编码方法采用排序数列索引进行偏移地址总线的自适应重排,通过冗余线实现最佳排序数列至存储器地址接收端的传送,相对于传统的地址总线编码方法,具有更... 详细信息

为了降低大负载地址总线的功耗,提出了一种新的低功耗自适应偏移量总线编码方法.该编码方法采用排序数列索引进行偏移地址总线的自适应重排,通过冗余线实现最佳排序数列至存储器地址接收端的传送,相对于传统的地址总线编码方法,具有更低的总线翻转频率.验证结果表明,采用自适应偏移量总线编码,地址总线的翻转频率降低了86.6%,功耗减少了69.2%,编码器本身的动态功耗和面积相当小,有效地实现了地址总线的低功耗工作.

关键词：偏移地址地址总线总线编码翻转频率低功耗

DSP程序地址总线低功耗分段Gray编码方法

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微计算机信息 2006年第2Z期22卷 162-164页

作者：黄越于宗光江南大学

地址总线的功耗是DSP功耗的重要来源。降低地址总线上的翻转率可以有效降低整个系统的功耗。文章在分析CMOS电路功耗基础上,提出了一种改进的Gray编码。结果表明,采用此种编码可以有效地降低DSP程序地址总线功耗。

关键词：地址总线低功耗编码 DSP Gray编码

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地址总线检测方法

科技资讯 2018年第10期16卷 44-45,47页

作者：袁智荣锐捷网络股份有限公司福建福州350002

在通信电子产品中,总线运用非常普遍,为了提高产品的可靠性,通常需要对总线进行检测。总线检测的内容主要包括数据总线、控制总线和地址总线的检测。对于数据总线和控制总线的检测,比较简单,一般只要保证写入的数据和读出的数据一致就... 详细信息

在通信电子产品中,总线运用非常普遍,为了提高产品的可靠性,通常需要对总线进行检测。总线检测的内容主要包括数据总线、控制总线和地址总线的检测。对于数据总线和控制总线的检测,比较简单,一般只要保证写入的数据和读出的数据一致就可以判断数据总线和控制总线是否正确;对于地址总线,由于地址信息是由CPU发给功能单元的单项输出信息,因此即使在芯片引脚短路或开路情况下,CPU也无法发现其错误的存在。本文针对非存储器类的芯片设计了一种可靠的地址总线检测方法,在利用现有电路的基础上,通过两个特殊的地址再配合一定的算法,即能达到地址总线检测的目的。

关键词：地址总线检测方法

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一种新型的地址总线取址方法

电子世界 2021年第22期 160-161页

作者：廖芹四创电子股份有限公司

本文提供了一种新型的地址总线取址方法,用于一些插槽机箱的背板接口的地址映射,便于数据通信。即通过SPI总线与CPU进行通信,IO资源占用少;通过分压取地址的方式,只需改变背板的分压电阻值,细分电压档位就可以扩展插槽;且取址方法精度高... 详细信息

本文提供了一种新型的地址总线取址方法,用于一些插槽机箱的背板接口的地址映射,便于数据通信。即通过SPI总线与CPU进行通信,IO资源占用少;通过分压取地址的方式,只需改变背板的分压电阻值,细分电压档位就可以扩展插槽;且取址方法精度高,任何一个功能模块插在这个插槽里面,通过AD采集,处理器即可通过SPI总线的通信方式得知功能模块的地址。

关键词：地址总线 SPI总线地址映射扩展插槽分压电阻数据通信功能模块通信方式

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零翻转编码地址总线SoC的低功耗设计

单片机与嵌入式系统应用 2004年第1期4卷 12-14页

作者：殷宏陆生礼东南大学

分析系统芯片(SoC)设计中大电容负载的地址总线低功耗设计方法;利用地址总线零翻转编码和解码技术,有效地减少SoC地址总线活动,降低SoC芯片和系统的功耗;同时,应用于实际的SoC设计中,验证它的功能和适用范围。

关键词：数字集成电路系统芯片 SoC芯片低功耗设计编码地址总线

188/48地址总线缓冲控制逻辑电路替代方案

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七一六所科技学报 1995年第2期 27-30页

作者：张文丽

本文简析了ｉＳＢＣ１８８／５６地址总线缓冲控制逻辑电路，介绍了一种１６ＲＭＣＳ系列１８８／４８地址总线缓冲控制逻辑电路替代方案，已验证之。

关键词：地址总线缓冲控制器逻辑电路通信计算机

一种DSP对地址数据总线复用器件的驱动方法

维普期刊数据库评论

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工矿自动化 2010年第7期36卷 131-134页

作者：邵勇张国强康安明煤炭科学研究总院常州自动化研究院江苏常州213015 枣庄矿业集团柴里煤矿山东枣庄277519 江苏科技大学计算机科学与工程学院江苏镇江212003

针对工业控制开发领域存在的器件总线结构不兼容问题,提出了一种采用CPLD实现的DSP驱动地址数据总线复用器件的方法,并以TMS320LF2407A DSP访问DS12C887时钟芯片为例讲述了具体实现过程,并给出了在设计过程中应注意的速度匹配、信号电... 详细信息

针对工业控制开发领域存在的器件总线结构不兼容问题,提出了一种采用CPLD实现的DSP驱动地址数据总线复用器件的方法,并以TMS320LF2407A DSP访问DS12C887时钟芯片为例讲述了具体实现过程,并给出了在设计过程中应注意的速度匹配、信号电平匹配、信号格式匹配和时序匹配等问题。实践证明,该方法简便可靠,是一种解决两种总线器件互联的可行方案。

关键词：地址总线数据总线分时复用 DSP CPLD 驱动

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一种面向嵌入式系统总线的低功耗优化方法

计算机科学 2013年第12期40卷 31-36页

作者：葛红美徐超陈念廖希密武汉大学计算机学院武汉430072 徐州工业职业技术学院信息管理技术学院徐州221000 武汉大学软件工程国家重点实验室武汉430072

为了解决嵌入式系统设备总线的功耗问题,从软件方面的功耗优化入手,提出一种面向嵌入式系统总线的低功耗优化方法,即在编译阶段,分别对指令地址总线和数据总线进行优化,以减少总线的翻转次数,降低其功耗。具体方法为:针对指令地址总线,... 详细信息

为了解决嵌入式系统设备总线的功耗问题,从软件方面的功耗优化入手,提出一种面向嵌入式系统总线的低功耗优化方法,即在编译阶段,分别对指令地址总线和数据总线进行优化,以减少总线的翻转次数,降低其功耗。具体方法为:针对指令地址总线,采用改进后的遗传算法进行函数段调用优化,然后结合T0编码,减少总线翻转次数,从而降低其功耗。针对指令数据总线,采用粒子群算法进行指令调度优化,然后结合0-1翻转编码,减少总线翻转次数,从而降低其功耗。为了验证上述方法的正确性和有效性,以HR6P系列微处理器为平台展开实验,实验结果表明,总线功耗的优化效率达到25%左右。该方法明显减少了总线的翻转次数,提高了系统的整体性能。

关键词：低功耗编译优化地址总线数据总线

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奇产生器预置型格雷码计数器的GAL实现

微电子学与计算机 2013年第2期30卷 50-52,56页

作者：李正生马文彦闫杰西北工业大学航天学院陕西西安710072 第二炮兵工程大学陕西西安710025

格雷编码的计算机程序存贮器地址总线没能推广的主要问题是格雷码计数器不便于置数.将奇产生电路用于格雷码计数器中,设计了附加位预置型和直接预置型两种可置数格雷码加法计数器.并用GAL16V8对后者进行了加电验证,证实了设计的有效性.

关键词：格雷码计数器预置奇偶性奇产生器异或门程序计数器地址总线通用逻辑阵列