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面向大批量定制的敏捷产品可重用方法研究

中国机械工程 2004年第2期15卷 131-134页

作者：冯毅雄谭建荣郑兵纪杨建浙江大学CAD&CG国家重点实验室杭州310027 大连大学工商管理学院

提出了一系列支持大批量定制敏捷产品设计单元的可重用规则 ,通过设计单元自律、演变、关联与一整套规则的紧密结合 ,将约束规则与设计单元构造大批量定制敏捷产品的过程相对应 ,使大批量定制敏捷产品设计单元的可重用过程反映设计意图 ... 详细信息

提出了一系列支持大批量定制敏捷产品设计单元的可重用规则 ,通过设计单元自律、演变、关联与一整套规则的紧密结合 ,将约束规则与设计单元构造大批量定制敏捷产品的过程相对应 ,使大批量定制敏捷产品设计单元的可重用过程反映设计意图 ;最后给出了面向大批量定制的敏捷产品可重用设计算法。

关键词：产品设计单元大批量定制敏捷产品可重用

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可重用面向对象数控软件及其开发环境研究

华中理工大学学报 1999年第3期27卷 19-21页

作者：魏仁选周祖德陈幼平阳代平华中理工大学机械科学与工程学院

通过对数控软件的标准化、规范化研究，运用面向对象机制，对数控软件功能与数据进行抽象并进行封装，设计成具有稳定、通用接口的可重用的软件芯片，建立一个类似硬件芯片的高可靠性数控系统软件芯片库．设计了软件芯片库管理器；实现... 详细信息

通过对数控软件的标准化、规范化研究，运用面向对象机制，对数控软件功能与数据进行抽象并进行封装，设计成具有稳定、通用接口的可重用的软件芯片，建立一个类似硬件芯片的高可靠性数控系统软件芯片库．设计了软件芯片库管理器；实现芯片库的浏览、检索及维护，以及图形化应用程序集成工具；完成应用程序的功能配置与代码生成；

关键词：数控系统面向对象可重用软件 CNC

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可重用的学习对象及其应用策略

电化教育研究 2003年第8期24卷 13-17页

作者：刘清堂杨宗凯付琴华中科技大学电子与信息工程系湖北武汉430074

学习对象的数据模型是建立在学习对象元数据标准和学习对象内容包装标准之上 ,并通过可扩展标记语言 XML进行描述和绑定。本文依据远程教育的相关标准和规范 ,通过学习对象特性的分析 ,对可重用的学习对象模型进行了研究 ,重点研究了在... 详细信息

学习对象的数据模型是建立在学习对象元数据标准和学习对象内容包装标准之上 ,并通过可扩展标记语言 XML进行描述和绑定。本文依据远程教育的相关标准和规范 ,通过学习对象特性的分析 ,对可重用的学习对象模型进行了研究 ,重点研究了在学习对象的应用模型支持下的学习内容元数据描述标准和学习内容包装标准的整合使用 ,提出了学习对象的重用和共享的策略和方法 ,并探讨了在网络教育中的应用方法 ,同时对可重用的学习对象在网络教育应用中可能遇到的问题进行了分析。

关键词：学习对象可重用策略元数据内容包装

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高性能处理器层次化可重用模拟验证环境

中国科学：信息科学 2015年第4期45卷 535-547页

作者：胡向东巨鹏锦朱英孙路国家高性能集成电路设计中心上海201204

高性能处理器的多核化和So C(system on chip)集成化发展趋势,使得处理器芯片设计复杂度和规模成倍增长,平面式的模拟验证环境在消耗大量机器资源的同时模拟速度急剧下降,严重影响模拟验证效率,而当前模拟验证仍是处理器验证中最广泛的... 详细信息

高性能处理器的多核化和So C(system on chip)集成化发展趋势,使得处理器芯片设计复杂度和规模成倍增长,平面式的模拟验证环境在消耗大量机器资源的同时模拟速度急剧下降,严重影响模拟验证效率,而当前模拟验证仍是处理器验证中最广泛的验证手段.为提高模拟验证效率,必须建立高效的处理器模拟环境.根据高性能处理器架构特点,基于可重用验证组件开发思想,建立层次化可重用的处理器模拟验证环境,可有效解决高性能处理器模拟验证中内存消耗大、模拟速度慢、验证效率低等问题.这种环境创建方法可以缩短环境创建和调试周期,减少环境自身错误,有利于不同处理器验证环境的可重用.

关键词：处理器多核模拟验证层次化可重用验证组件

堆叠式可重用农业物联网智能硬件设计及可靠性研究

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中国农机化学报 2020年第5期41卷 163-169页

作者：伍冯洁林佳翰朱国柱潘伟旋广州大学实验中心广州市510006 广州大学物理与电子工程学院广州市510006 广州大学机械与电气工程学院广州市510006

针对目前农业物联网大多面向具体应用场所设计开发,存在标准不统一、信息融合度不高、兼容性较差等不足,提出一种堆叠式可重用系统设计理念,采用模块化及可重用设计方法完成农业物联网智能硬件的软硬件设计,重点完成感知层传感器模块与... 详细信息

针对目前农业物联网大多面向具体应用场所设计开发,存在标准不统一、信息融合度不高、兼容性较差等不足,提出一种堆叠式可重用系统设计理念,采用模块化及可重用设计方法完成农业物联网智能硬件的软硬件设计,重点完成感知层传感器模块与控制板、贯通式数据链路接口的设计,实现农业物联网智能硬件在三维空间的堆叠与插拔;同时制定一套适用于农业物联网的通信协议,设计统一的数据通信格式,并采用三级编码方式编制传感器身份标识码;最后进行软硬件测试与数据分析。试验表明,大部分传感器终端设备,只要遵守提出的数据通信规范,就能自动接入无线通信网络实现农业信息的实时监控,并且丢包和误码率维持在3%以内,显著提高农业物联网系统的智能型与兼容性,使得用户配置、部署与维护升级更简单、灵活。

关键词：农业物联网智能硬件堆叠式可重用

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可重用嵌入式USB主机驱动的设计与实现

可重用嵌入式USB主机驱动的设计与实现

作者：柳荫上海交通大学

学位级别：硕士

USB是一种“主从”（主机/外设）结构的通用串行总线技术,具有简单灵活、高带宽、可靠性强、易于扩展和热插拔等优点,传统的USB主机大都位于PC上,USB设备只能连接PC进行应用。随着消费类电子产品的飞速发展,越来越多的嵌入式系统中集成... 详细信息

USB是一种“主从”（主机/外设）结构的通用串行总线技术,具有简单灵活、高带宽、可靠性强、易于扩展和热插拔等优点,传统的USB主机大都位于PC上,USB设备只能连接PC进行应用。随着消费类电子产品的飞速发展,越来越多的嵌入式系统中集成了USB主机控制器,这就要求在嵌入式设备上实现一套USB主机驱动程序。传统意义上的USB驱动程序开发都是针对USB外设驱动的开发,主控制器驱动大部分由操作系统来提供。在USB主机开发领域中,基于桌面的两大主流操作系统中,Windows不公开源码而Linux的代码却不方便移植;而在嵌入式操作系统中,诸如μCOS,VxWorks和QNX等OS的USB主机协议栈也是不公开的。因此,对于芯片设计和方案提供厂商来说,自主实现一整套通用性强且方便移植的USB主机驱动程序将会有更大的意义。另外,在大多数自行开发的嵌入式USB系统软件中,底层驱动程序、操作系统和应用程序的界线往往是不清晰的,这样增加了软件的耦合度,一旦硬件和操作系统发生变更时,维护成本和风险大大增加,更降低了代码的可重用性。在这种背景下,本文提出通过对现在较新版本Linux中的USB主机驱动程序进行裁减和移植,结合嵌入式系统的特点,设计出一套可重用性高,通用性强的嵌入式USB主机驱动程序。本文先学习了USB主机系统的软硬件结构,在此基础上研究了Linux中USB的主机驱动架构,对移植的难度进行了分析。然后基于可重用的思想设计出了嵌入式系统中USB主机驱动的软件架构。接下来本文通过裁减和修改核心数据结构,替换OS接口等方法对Linux中USB主机驱动进行移植。最后本文将USB主机驱动应用在一个高性能的嵌入式系统机顶盒中,实现对于大容量存储设备的支持。并通过测试给出了此USB主机驱动在可重用性、功能性和稳定性上的验证结论。

关键词：嵌入式系统 USB主机可重用 Linux 移植

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可重用片上仿真调试协议结构

微电子学与计算机 2011年第2期28卷 6-10页

作者：刘蓬侠国防科技大学计算机学院湖南长沙410073

提出了一种可重用片上仿真调试协议结构,基于此结构设计实现的片上仿真调试逻辑,简单高效,便于重用于新的芯片和新的体系结构.

关键词：可重用片上仿真调试协议结构

一种基于可重用激励发生机制的SoC验证平台

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计算机工程与科学 2016年第7期38卷 1309-1315页

作者：苏艺端虞致国顾晓峰江南大学电子工程系物联网技术应用教育部工程研究中心江苏无锡214122

在系统芯片的设计中,传统的激励发生机制耗费人工多且难以重用,严重影响了仿真验证的效率。针对此问题,构建了一种基于可重用激励发生机制的虚拟SoC验证平台。该平台利用可重用的激励发生模块调用端口激励文件,仿真时将端口激励文件转... 详细信息

在系统芯片的设计中,传统的激励发生机制耗费人工多且难以重用,严重影响了仿真验证的效率。针对此问题,构建了一种基于可重用激励发生机制的虚拟SoC验证平台。该平台利用可重用的激励发生模块调用端口激励文件,仿真时将端口激励文件转换成对应于验证电路端口的时序信号。通过对通用同步/异步串行接收/发送器、中断及定时器等功能模块的验证,证明了激励发生机制具有较强的可观察性、可控制性及可重用性。验证结果分析表明,在验证不同的功能点时仅需修改固件及端口激励文件,使验证平台在重用时减少代码修改量,提高了灵活性和验证效率,缩短了系统芯片的验证时间。

关键词：可重用激励发生机制虚拟SoC验证平台端口激励文件

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可重用维特比译码器的设计

可重用维特比译码器的设计

作者：朱胜清华大学

学位级别：硕士

维特比译码算法是卷积编码的最大似然译码算法。维特比译码器是维特比译码算法的VLSI实现。在数字通信领域,卷积码编码应用得很广泛,因此如何提高维特比译码器的性能,降低译码器的面积和功耗,是一个很重要的问题。同时,由于不同的标准... 详细信息

维特比译码算法是卷积编码的最大似然译码算法。维特比译码器是维特比译码算法的VLSI实现。在数字通信领域,卷积码编码应用得很广泛,因此如何提高维特比译码器的性能,降低译码器的面积和功耗,是一个很重要的问题。同时,由于不同的标准所使用的卷积码不完全相同,不同的应用对译码器的速度、面积和功耗的要求也不尽相同,因此设计一个具有可重用的维特比译码器也具有很重要的意义。论文首先设计了一个基四流水线结构、状态串行、带删除的64状态(4,1,6)维特比译码器。在设计路径度量存储单元(PMU,Path Metric Unit)时,采用了同址写回(SAWB, Same Address Write Back)技术,减少了一半的寄存器。设计幸存路径存储单元(SMU,Survivor path Memory Unit)时,采用了回溯(Trace Back)的输出方式和分块的内存管理,降低了读取内存的功耗。整体的设计采用数据驱动的方式,减少了电路不必要的操作。在TSMC 0.18(m CMOS 工艺下,电路规模仅1.3万门(不含RAM),最高时钟频率可达100MHz,译码速率可达12.5M bps,相应的功耗为15mW。论文的另一部分工作是在此设计的基础上设计了一个可重用的维特比译码器。该译码器采用处理器单元(PE, Process Element)互连的整体结构,可以很方便地配置处理器单元的个数以提高译码器的处理速度。在路径度量存储单元中同样采用同址写回技术,减少了一半的寄存器。基于上面这些技术,该译码器的一些关键参数,例如卷积码的生成多项式、处理单元的个数和回溯深度等等,可以根据应用的需要进行配置。论文中设计了一个可以根据这些参数自动生成VERILOG代码的工具,使用这个工具生成的VERILOG代码已经在TSMC 0.18(m CMOS工艺下成功地进行了综合仿真。

关键词：维特比译码器可重用低功耗集成电路设计