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基于二维光子晶体的半加器设计与优化

激光与光电子学进展 2022年第1期59卷 310-315页

作者：张岩李梦凡陈德媛南京邮电大学电子与光学工程学院、微电子学院江苏南京210023

在完整的二维三角晶格硅中引入线缺陷和点缺陷,利用波导耦合和线性干涉,提出了一种基于光子晶体的全光半加器结构。半加器由波导分束器、全光逻辑与门和全光逻辑异或门组成。利用Rsoft软件,结合平面波展开法和时域有限差分法对所提半加... 详细信息

在完整的二维三角晶格硅中引入线缺陷和点缺陷,利用波导耦合和线性干涉,提出了一种基于光子晶体的全光半加器结构。半加器由波导分束器、全光逻辑与门和全光逻辑异或门组成。利用Rsoft软件,结合平面波展开法和时域有限差分法对所提半加器进行仿真研究。结果表明,所提半加器在波长为1530 nm时"进位"和"和位"端口的对比度分别为4.67 dB和10.77 dB,响应时间约为2.67 ps。为了提高"进位"端口的对比度,文中对半加器的结构进行了优化。优化后的半加器"进位"和"和位"端口的对比度分别为8.26 dB和15.34 dB,响应时间为3.67 ps,理论上可以达到0.273 Tbps的数据传输速率。所提出优化后的半加器具有较高的对比度,在全光信号处理系统和集成光路中具有重要作用。

关键词：光学器件光逻辑器件半加器光子晶体

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全光半加器的研究进展

半导体光电 2009年第5期30卷 647-652页

作者：孙晓寅李培丽徐荣青南京邮电大学光电工程学院南京210003

综述了全光半加器的研究进展和现状。阐述了不同结构全光半加器的工作原理、优缺点,并展望了全光半加器未来的发展方向。

关键词：半加器半导体光放大器周期极化铌酸锂与门异或门

两种DNA分子同时检测的逻辑门及半加器的构建

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分析科学学报 2017年第6期33卷 763-768页

作者：晋晓勇张笛蒙丽君许凯歌雷杰彭娟宁夏大学化学化工学院省部共建煤炭高效利用与绿色化工国家重点实验室宁夏银川750021

本研究利用滴涂法和电沉积法构建了氧化石墨烯/金纳米粒子复合膜修饰电极(GCE/GO/AuNPs),基于目标DNA和探针结合前后探针在电极表面构型的变化导致电化学信号变化,实现对大肠杆菌(***)DNA和沙门氏菌(Sal)DNA的智能识别。以目标物为输入... 详细信息

本研究利用滴涂法和电沉积法构建了氧化石墨烯/金纳米粒子复合膜修饰电极(GCE/GO/AuNPs),基于目标DNA和探针结合前后探针在电极表面构型的变化导致电化学信号变化,实现对大肠杆菌(***)DNA和沙门氏菌(Sal)DNA的智能识别。以目标物为输入信号,分别以Σ|ΔI|和|ΔIMB/ΔIFc|为输出,构建了"AND"型和"XOR"型DNA分子逻辑门,提出了一种新型的可用于逻辑运算的半加器模型。采用方波伏安法(SWV)检测两种标记探针电流变化值Σ|ΔI|,其与*** DNA和Sal DNA浓度的对数值在1.0×10^(-13)~1.0×10^(-8) mol·L^(-1)范围内呈现良好的线性关系,检出限(S/N=3)分别为3.2×10^(-14) mol·L^(-1)和1.7×10^(-14) mol·L^(-1)。

关键词： DNA分子逻辑门电化学检测半加器生物传感器

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三值光计算机的对称三进制半加器原理设计

计算机工程 2007年第17期33卷 278-279页

作者：蔡超金翊包九龙汪宇涛上海大学计算机工程与科学学院上海200072

提出了在三值光计算机中采用对称三进制半加器的观点,设计了支持这个观点的半加器结构原理图。与传统二进制电子计算机加法器相比,该设计体现了对称三进制表示将加法运算和减法运算合而为一的优点,避免了补码运算。论述了对称三进制加... 详细信息

提出了在三值光计算机中采用对称三进制半加器的观点,设计了支持这个观点的半加器结构原理图。与传统二进制电子计算机加法器相比,该设计体现了对称三进制表示将加法运算和减法运算合而为一的优点,避免了补码运算。论述了对称三进制加法运算的规律,介绍了所设计半加器的工作原理,为三值光计算机逻辑运算器以及后续研究提供了理论指导意义。

关键词：光计算机半加器三值计算机对称三进制

一种新型单电子-MOS晶体管混合的半加器电路

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空军工程大学学报（自然科学版） 2008年第1期9卷 78-81页

作者：李芹蔡理王森吴刚空军工程大学理学院陕西西安710051

基于单电子晶体管的I-V特性和MOS晶体管的逻辑电路设计思想,提出了1个单电子晶体管和MOS晶体管混合的反相器电路,进而推导出其它基本逻辑门电路,并最终实现了一个半加器电路。通过比较单电子晶体管和MOS晶体管两者的混合与纯CMOS晶体管... 详细信息

基于单电子晶体管的I-V特性和MOS晶体管的逻辑电路设计思想,提出了1个单电子晶体管和MOS晶体管混合的反相器电路,进而推导出其它基本逻辑门电路,并最终实现了一个半加器电路。通过比较单电子晶体管和MOS晶体管两者的混合与纯CMOS晶体管实现的半加器电路,元器件数目得到了减少,电路结构得到简化,且电路的静态功耗降低。SPICE验证了电路设计的正确性。

关键词：单电子晶体管 MOS晶体管反相器半加器 SPICE

超高速ECL四位半加器设计与研制的有关问题

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清华大学学报(自然科学版) 1976年第2期 104-113页

作者： Graduation Practice Group, Specialty of Semiconductors, Factory of Electronic Instruments, Peking University 北京大学电子仪器厂半导体专业七二级毕业实践小组

The design and fabrication of a super speed ECL 4-digit half-additor IC are reported in this paper. The final design of the IC is given in considerable detail. A number of problems encountered during the course of the work are discussed, They include, namely, design considerations on circuit speed and certain reference voltages in the circuit, design and fabrication problems relating to the Ic-Vbe characteristics of the transistors, and the diffused resistors design. The IC reported are now in small scale production at our factory.

关键词：基区晶体管半导体三极管 ECL 正向压降发射极加法器半加器发射区动态电阻电路设计版图设计设计值收集极传输特性曲线套刻参考电源发射结电流开关输入电平

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CMOS半加器电路鲁棒性设计

兰州交通大学学报 2016年第3期35卷 68-71页

作者：刘春娟徐晓瑞杨超山兰州交通大学电子与信息工程学院甘肃兰州730070

在数字电路设计中,电路逻辑功能和性能参数会随着数字逻辑器件的容差、延迟时间的改变而发生变化,甚至会引起不正常的逻辑关系.随着集成度不断提高,这种偏差严重影响电路的成品率,增加了电路设计的复杂性和成本.采用基于OrCAD/Pspice的... 详细信息

在数字电路设计中,电路逻辑功能和性能参数会随着数字逻辑器件的容差、延迟时间的改变而发生变化,甚至会引起不正常的逻辑关系.随着集成度不断提高,这种偏差严重影响电路的成品率,增加了电路设计的复杂性和成本.采用基于OrCAD/Pspice的最坏情况模拟及对器件模糊时间影响的抑制,对半加器逻辑电路参数进行适当修正,降低了输出结果不确定性及脉冲变窄或异常故障.所设计的加法器电路在满足原逻辑功能基础上,在指定的模糊时间变化范围内,电路稳定性得到明显提高,达到增强其鲁棒性的目的.

关键词：半加器鲁棒性模糊时间