检索结果-南通市图书馆

计算机应用 2012年第A1期32卷 85-87页

作者：梁红玉陈冬梅桂林电子科技大学信息与通信学院广西桂林541004

从信道纠错编码的基本思想出发,讨论了汉明码、扩展汉明码以及交织的纠错检错能力,提出了对扩展汉明码进行交织重排的算法。然后采用C语言对该算法进行程序设计,验证了该算法的可行性。结果表明:此种算法具有较强的抗干扰能力,提高了传... 详细信息

从信道纠错编码的基本思想出发,讨论了汉明码、扩展汉明码以及交织的纠错检错能力,提出了对扩展汉明码进行交织重排的算法。然后采用C语言对该算法进行程序设计,验证了该算法的可行性。结果表明:此种算法具有较强的抗干扰能力,提高了传输数据的可靠性。

关键词：扩展汉明码交织重排信道编码

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扩展汉明码信息协调协议

西南大学学报（自然科学版） 2011年第3期33卷 114-117页

作者：瞿云云陈云坤曹祖平曹慧贵州师范大学数学与计算机科学学院贵阳550001 西南大学数学与统计学院重庆400715 咸宁学院数学与统计学院湖北咸宁437100

提出了一种基于扩展汉明码与奇偶校验和的信息协调协议-扩展汉明码信息协调协议,分析了此协议的安全性与效率.与Winnow协议相比较,新协议具有原始密钥串初始误码率适用范围较大,迭代轮数较少和安全性高的优点.

关键词：扩展汉明码奇偶校验和信息协调 Winnow协议误码率

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扩展汉明码的编解码器设计及其FPGA实现

现代电子技术 2008年第19期31卷 187-188,191页

作者：王爱珍忻州师范学院山西忻州034000

采用扩展汉明码,实现了对汉明码纠、检错功能的扩展,使其功能扩展至一位纠错、两位检错。并且利用Verilog硬件语言对该编、解码方法进行了程序设计及仿真,最后下载至FPGA实现。结果证明,这种扩展汉明码的编、解码方法在不显著增加硬件... 详细信息

采用扩展汉明码,实现了对汉明码纠、检错功能的扩展,使其功能扩展至一位纠错、两位检错。并且利用Verilog硬件语言对该编、解码方法进行了程序设计及仿真,最后下载至FPGA实现。结果证明,这种扩展汉明码的编、解码方法在不显著增加硬件资源的基础上,提高了传输数据的可靠性,具有非常现实的意义。

关键词：硬件语言差错控制编码扩展汉明码 FPGA

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一种基于扩展汉明码的动态纠错机制

电子与封装 2022年第5期22卷 63-67页

作者：陈天培吴校生强小燕上海交通大学微米/纳米加工技术国家级重点实验室上海200240 中科芯集成电路有限公司江苏无锡214072

错误纠正码(Error Correction Code,ECC)是解决存储器数据出现一位或两位错误的有效手段,然而过于复杂的编码方式将降低读写性能。为解决该问题,提出了一种基于扩展汉明码的动态纠错机制。利用扩展汉明码的奇偶校验位对检错模块进行了优... 详细信息

错误纠正码(Error Correction Code,ECC)是解决存储器数据出现一位或两位错误的有效手段,然而过于复杂的编码方式将降低读写性能。为解决该问题,提出了一种基于扩展汉明码的动态纠错机制。利用扩展汉明码的奇偶校验位对检错模块进行了优化,能够监测错误发生的频率,并可动态切换进行扩展汉明码校验与奇偶校验。运用Verilog硬件描述语言实现了该机制并进行了仿真分析。分析结果表明,使用该机制与使用扩展汉明码校验相比,能够有效降低路径延时与动态功耗。

关键词：错误纠正码动态纠错机制扩展汉明码路径延时动态功耗

一种新型的近仙农理论极限的码:并行联接扩展汉明码

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应用科学学报 2000年第1期18卷 39-41页

作者：曹家麟邓家梅马世伟上海大学自动化系上海200072

用多维并行联接及扩展技术设计出一种新型的近仙农理论极限的码 :并行联接扩展汉明码 .编码器由多个扩展汉明码的并行联接组成 .译码器是基于文中给出的篱笆图技术 ,用最大后验概率的迭代译码方法得到的 .

关键词：并行联接扩展汉明码编码译码

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并行级联扩展汉明码的译码技术与性能

上海大学学报（自然科学版） 1999年第2期5卷 178-180页

作者：邓家梅曹家麟秦霆镐上海大学自动化学院

本文研究了并行级联扩展汉明码的编码、译码技术及其性能．这种码在中到高码率范围。

关键词：并行级联汉明码编码译码扩展汉明码

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基于多维乘积码的编码协作方案研究

信号处理 2010年第2期26卷 170-174页

作者：黄英雷菁国防科技大学电子科学与工程学院湖南长沙410073

多维乘积码是一种成熟的编码技术,其性能较好,且具有灵活的多维结构。本文提出一种基于多维乘积码的协作方案,利用不同维数的校验位进行协作,达到获取分集增益的目的。文中以分量码为扩展汉明码的多维乘积码为例,在慢衰落、快衰落瑞利... 详细信息

多维乘积码是一种成熟的编码技术,其性能较好,且具有灵活的多维结构。本文提出一种基于多维乘积码的协作方案,利用不同维数的校验位进行协作,达到获取分集增益的目的。文中以分量码为扩展汉明码的多维乘积码为例,在慢衰落、快衰落瑞利信道下进行了理论性能分析和计算机仿真,仿真结果显示:慢衰落信道下,BER为10-3时,协作程度为50%,用户间信道SNR大于10dB时,增益大于8dB;在快衰落信道下,可以通过该协作方案可达到帮助上行信道较差的用户的目的。从实用性和良好性能的角度来看,该编码协作将具有较好的应用前景。

关键词：多维乘积码编码协作扩展汉明码分集

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高斯白噪声信道下Turbo乘积码应用仿真

微计算机信息 2008年第22期24卷 250-251,299页

作者：张杰施浒立马冠一北京中国科学院国家天文台

本文介绍了一种新型的前向纠错编码方案——Turbo乘积码(TPC)。分析了Turbo乘积码的编译码原理。并对高斯白噪声信道下的TPC编译码性能进行了仿真。通过选取不同参数子码组合的性能对比,提出了最优的TPC编译码方案。仿真结果显示,与传... 详细信息

本文介绍了一种新型的前向纠错编码方案——Turbo乘积码(TPC)。分析了Turbo乘积码的编译码原理。并对高斯白噪声信道下的TPC编译码性能进行了仿真。通过选取不同参数子码组合的性能对比,提出了最优的TPC编译码方案。仿真结果显示,与传统的卷积码和Turbo码相比,Turbo乘积码不仅具有优异的误码率性能,而且可以做到更高的编码效率。

关键词： Turbo乘积码对数似然比迭代译码扩展汉明码 BPSK

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星载计算机SRAM加固可靠性的研究与设计

星载计算机SRAM加固可靠性的研究与设计

作者：赵春雨哈尔滨工业大学

学位级别：硕士

星载计算机是确保微小卫星正常运行的重要部分之一,它对卫星的指令控制、任务调度以及关键信息的分析等起着非常重要的作用。因为星载计算机经常在具有辐射的环境中执行任务,所以其SRAM(Static Random Access Memory,静态随机存储器)很... 详细信息

星载计算机是确保微小卫星正常运行的重要部分之一,它对卫星的指令控制、任务调度以及关键信息的分析等起着非常重要的作用。因为星载计算机经常在具有辐射的环境中执行任务,所以其SRAM(Static Random Access Memory,静态随机存储器)很容易遭到高能粒子的撞击而产生单粒子效应,进而使得存储数据发生错误。通常情况下,解决这种错误的一种有效方式为信息冗余即IC(Information Code,信息编码)。目前现有的基于IC保护后的星载SRAM的可靠性的分析存在一定的缺陷,同时在抗电离子翻转的硬件电路设计中,传统的做法是使用检错纠错芯片,无法对星载SRAM中已存在的错误的刷新,导致错误不断的累积,降低星载计算机的可靠性。因此本文以单粒子效应对星载SRAM造成的错误分布、错误的覆盖以及信息编码的特点为理论基础,研究IC保护后的星载SRAM的可靠性模型并设计相应的硬件电路,针对目前存在的缺陷和不足提出相应的改善和解决方案。IC保护后的星载SRAM的可靠性高低最终由MTTF(Mean Time To Failure,平均失效时间)进行评价。针对原始算法对IC保护星载SRAM后存在的不精确问题,本文根据实际星载SRAM内部存储结构的原理以及错误的分布情况,综合归纳出两种情况即错误分布特性和错误重合特性。完善并设计了一个由IC保护的星载SRAM的可靠性分析模型。得出一个更加准确的衡量可靠性的算法,有利于为IC保护的星载SRAM硬件电路的设计提供理论指导。针对星载计算机的SRAM可能会受到高能粒子的射击问题,设计一套抗辐射电路。采用信息编码的方式对SRAM中的数据进行保护,并研究扩展汉明码以及RM码的纠错原理。通过数学模型对可靠性的分析评估来确立硬件电路设计中的参数。用Verilog语言在FPGA上实现纠错电路并采用刷新模式来避免错误在星载SRAM中的累积,从而提高系统的可靠性。

关键词：星载计算机可靠性扩展汉明码 SRAM

基于FPGA的星载RAM抗SEU的研究与设计

同方学位论文库评论

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同方学位论文库

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基于FPGA的星载RAM抗SEU的研究与设计

作者：卜雷雷电子科技大学

学位级别：硕士

空间环境中存在着众多的宇宙射线和高能粒子,运行于其中的星载计算机很容易受到这些射线和粒子的冲击从而产生各种辐射效应。星载计算机上的双稳态器件如静态存储器SRAM就可能在辐射的作用下出现单粒子翻转效应(Single Event Upset,SEU)... 详细信息

空间环境中存在着众多的宇宙射线和高能粒子,运行于其中的星载计算机很容易受到这些射线和粒子的冲击从而产生各种辐射效应。星载计算机上的双稳态器件如静态存储器SRAM就可能在辐射的作用下出现单粒子翻转效应(Single Event Upset,SEU),导致存储器中的数据的某一位从一个状态变为另一个状态。在存储器中出现这样的错误如果不能及时的发现并纠正,则可能导致星载计算机出现误操作,甚至出现更严重的后果,所以很有必要对星载RAM进行抗SEU的设计。此外,由于卫星造价高昂,人们更希望在一颗卫星上完成尽量多的任务,所以卫星上会集成更多功能。这些不同的功能有不同的应用需求,对存储器的容量与抗辐射性能也有不同的要求,于是也很有必要对星载RAM的灵活性加以改善。本课题正是基于对以上问题的考虑,使用可调的存储器配置方案,同时采用(22,16)扩展汉明码编码与三模冗余(Triple Modular Redundancy,TMR)相结合的方式对星载RAM进行抗SEU的设计。本论文详细阐述了(22,16)扩展汉明码与TMR的检错纠错原理。使用VHDL语言分别实现了扩展汉明码检错纠错电路与TMR检错纠错电路。为了验证设计的有效性,使用TMS320C6713 DSP搭建验证电路平台,采用软件故障注入法对设计进行验证。经过本设计加固的星载RAM可以对存储器进行在线配置,可以采用两种不同的存储器检错纠错方式。同时,与典型的EDAC芯片相比,本系统实现了差错的实时回写。

关键词： RAM SEU 扩展汉明码三模冗余