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双端口旋转对微波加热均匀性和互耦的影响

太赫兹科学与电子信息学报 2020年第2期18卷 264-268,277页

作者：李伊帆王凤霞解田朱铧丞杨阳黄卡玛四川大学电子信息学院四川成都610065 瓮福(集团)有限责任公司中低品位磷矿及其共伴生资源高效利用国家重点实验室贵州贵阳550501

微波加热相对于传统热传导加热具有内外加热的效果,但其在工业应用中存在加热效率低下、加热不均匀等问题。据此,提出一种基于双端口非同步旋转结构的加热方法,降低端口间的互耦;并基于COMSOL Multiphysics建立了双端口旋转下的微波加... 详细信息

微波加热相对于传统热传导加热具有内外加热的效果,但其在工业应用中存在加热效率低下、加热不均匀等问题。据此,提出一种基于双端口非同步旋转结构的加热方法,降低端口间的互耦;并基于COMSOL Multiphysics建立了双端口旋转下的微波加热模型,分析了双微波源端口之间的旋转速度对端口间的互耦和加热均匀性的影响,实现了端口间低互耦、高均匀性的加热,同时极大提高了微波加热的效率。

关键词：双端口旋转速度互耦均匀性效率

双端口RAM和光纤通讯在发动机电控系统标定开发中的应用

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电子技术应用 1998年第10期24卷 49-50页

作者：姜述刚袁大宏清华大学汽车工程系

介绍双端口ＲＡＭ和光纤通讯在发动机电控系统标定开发中的应用。

关键词：发动机电控系统标定双端口 RAM 光纤汽车

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双端口存储系统的设计

测控技术 1991年第4期10卷 10-12页

作者：张希军沈兰荪宇正武李智群中国科技大学

在高速数据采集,测控技术以及多处理器系统的设计中,往往需要高速传送大量的数据,双端口存储器作为一种新型的存储结构,数据传送速率仅受存储器存取时间的限制,已得到了广泛的应用。本文分析了双端口存储器的原理,介绍了双端口存储器的... 详细信息

在高速数据采集,测控技术以及多处理器系统的设计中,往往需要高速传送大量的数据,双端口存储器作为一种新型的存储结构,数据传送速率仅受存储器存取时间的限制,已得到了广泛的应用。本文分析了双端口存储器的原理,介绍了双端口存储器的设计方法,还讨论了双端口存储器的扩展及其在处理器联网中的应用。

关键词：双端口存贮器设计

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双端口声源特性的多负载测量方法

科学技术与工程 2013年第20期21卷 5761-5765,5780页

作者：张浩冯涛刘碧龙刘克中国科学院噪声与振动重点实验室(声学研究所) 北京100190 北京工商大学机械工程学院北京100048

针对管道中的声源测量问题,提出了一种双端口多负载法。方法不需要使用外加声源,通过改变管道末端的声学负载来改变管道中的声场,从而得到声源的辐射特性和传递特性。利用双端口多负载法测量了空气管道中轴流风扇的声学特性,与传统外加... 详细信息

针对管道中的声源测量问题,提出了一种双端口多负载法。方法不需要使用外加声源,通过改变管道末端的声学负载来改变管道中的声场,从而得到声源的辐射特性和传递特性。利用双端口多负载法测量了空气管道中轴流风扇的声学特性,与传统外加声源法测量结果符合较好。双端口多负载法可以应用在待测声源很强而导致外加声源法无法实施的情况。

关键词：双端口负载测量声学

双端口存储器的设计及其在高速数据采集与处理中的应用

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电子技术应用 1994年第8期20卷 9-11页

作者：李锦飞煤科总院西安分院 710054

介绍双端口存储器的硬件设计及其在由MCS-51单片机和16/32位高速数字信号处理器TMS32010组成的主从式计算机系统中的应用.TMS32010在MCS-51的管理下完成高速数据采集及数据处理,MCS-51通过对双端口存储器控制权的切换可快速得到TMS32101... 详细信息

介绍双端口存储器的硬件设计及其在由MCS-51单片机和16/32位高速数字信号处理器TMS32010组成的主从式计算机系统中的应用.TMS32010在MCS-51的管理下完成高速数据采集及数据处理,MCS-51通过对双端口存储器控制权的切换可快速得到TMS321010的采集及处理的结果.

关键词：双端口数据采集数据处理存储器

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双端口RAM实现任意波形发生器

计算机应用研究 1997年第3期14卷 81-82页

作者：袁波程建溪安徽大学人工智能所东关水泥厂

本文讨论了双端口ＲＡＭ的结构、特点，利用双端口ＲＡＭ同时读写同一ＲＡＭ芯片的特点。

关键词：双端口 RAM 存储单元任意波形发生器

用于DSP的双端口、多路可变L1 D-cache设计

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微电子学与计算机 2009年第2期26卷 184-187,192页

作者：贾迪何虎孙义和清华大学微电子学研究所清华信息科学与技术国家实验室北京100084

提出了一个用于高性能嵌入式DSP(Digital Signal Processor)的L1数据高速缓存(Level1D-cache)设计.它采用组关联(set-associative)结构,并且具有双端口、多路可变等特点.在设计中,实现了一系列优化技术,以满足高性能嵌入式DSP访问数据... 详细信息

提出了一个用于高性能嵌入式DSP(Digital Signal Processor)的L1数据高速缓存(Level1D-cache)设计.它采用组关联(set-associative)结构,并且具有双端口、多路可变等特点.在设计中,实现了一系列优化技术,以满足高性能嵌入式DSP访问数据的需要,并提高访问的能量效率.为了验证复杂的L1数据高速缓存控制器,提出了一个系统级的仿真模型,并且介绍了相应的验证策略.实验结果表明,该L1数据高速缓存的缺失率和缺失代价比没有采用优化技术的设计分别降低了约5%和20%;验证策略能够有效地提高验证效率,缩短验证时间.

关键词： L1数据高速缓存双端口多路可变验证策略

Torus拓扑结构的双端口NoC模型与性能分析

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电子测量与仪器学报 2017年第3期31卷 361-368页

作者：宋宇鲲钱庆松张多利合肥工业大学微电子设计研究所合肥230009

为了充分利用片上网络的并行通信能力,挖掘网络带宽利用率,设计了一种高性能的双端口片上网络。该网络中每个路由节点提供两个本地端口,每个资源节点采用对角线的方式接入到网络中两个路由节点上,并针对这种接入结构提出一种目的节点切... 详细信息

为了充分利用片上网络的并行通信能力,挖掘网络带宽利用率,设计了一种高性能的双端口片上网络。该网络中每个路由节点提供两个本地端口,每个资源节点采用对角线的方式接入到网络中两个路由节点上,并针对这种接入结构提出一种目的节点切换方法用于提高网络的并行通信能力。同时,为进一步提高新路由结构的性能,将双端口路由节点引入Torus结构,构造了基于Torus的双端口网络的模型,并对其进行性能评估。实验结果表明,基于Torus结构的对角线双端口NoC在单目事物实验中较单端口网络平均吞吐量和平均包延迟最大改善了83.3%和55.9%,在双目事物实验中较同一维序双端口网络平均吞吐量和平均包延迟最大改善了91.1%和54.3%。

关键词：片上网络双端口路由算法 Torus

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一种新颖的双端口数据高速缓冲存储器

微电子学 2003年第6期33卷 537-540页

作者：张卫新单睿侯朝焕中国科学院研究生院中国科学院声学研究所北京100080

　VLIW体系结构是媒体处理器的首选技术。解决处理器内核与访存之间的数据瓶颈,可以采用双Load/Store单元。为此,需要开发具有双端口访问能力的数据高速缓冲存储器。通过分析双端口情况下的系统工作时序、缺失(miss)处理和替换算法,设... 详细信息

　VLIW体系结构是媒体处理器的首选技术。解决处理器内核与访存之间的数据瓶颈,可以采用双Load/Store单元。为此,需要开发具有双端口访问能力的数据高速缓冲存储器。通过分析双端口情况下的系统工作时序、缺失(miss)处理和替换算法,设计并实现了一个4路组相连、容量为16kB的双端口数据高速缓冲存储器。通过在高速缓冲存储器内使用双端口SRAM,使其具有真正双端口并行访问能力,提高了处理器内核的数据吞吐能力。

关键词：高速缓冲存储器双端口超长指令字微处理器 SRAM Load/Store