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部分扫描可测性设计中扫描链的构造

半导体技术 1997年第2期13卷 40-45页

作者：叶波郭辉郑增钰复旦大学专用集成电路与系统国家重点实验室

提出了时序电路的部分扫描法可测性设计中扫描链的构造方法，包括扫描链的选取、扫描链的排序、多链扫描设计三部分内容。采用组合等效电路的方法求测试向量，并用实例进行了验证。模拟结果表明，选取２０％～４０％的触发器至扫描链，... 详细信息

提出了时序电路的部分扫描法可测性设计中扫描链的构造方法，包括扫描链的选取、扫描链的排序、多链扫描设计三部分内容。采用组合等效电路的方法求测试向量，并用实例进行了验证。模拟结果表明，选取２０％～４０％的触发器至扫描链，用较少的测试向量，可达到很理想的故障覆盖率。

关键词：扫描设计扫描链多链扫描 VLSI

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部分并行扫描法可测性设计的一种新结构

固体电子学研究与进展 1995年第3期15卷 302-306页

作者：叶波陈瑜华郑增钰复旦大学专用集成电路与系统国家重点实验室

提出了一种新的并行扫描结构。扫描触发器的选择采用ＢＡＬＬＡＳＴ算法。该结构采用译码的方式依次选通每个扫描小组，使得扫描小组中的存储元件并行地控制和观测。测试产生和响应时间比串行扫描法快Ｋ倍（Ｋ为并行度），而硬件耗费比... 详细信息

提出了一种新的并行扫描结构。扫描触发器的选择采用ＢＡＬＬＡＳＴ算法。该结构采用译码的方式依次选通每个扫描小组，使得扫描小组中的存储元件并行地控制和观测。测试产生和响应时间比串行扫描法快Ｋ倍（Ｋ为并行度），而硬件耗费比多链扫描法和传统的并行扫描结构小很多。

关键词：并行扫描扫描触发器并行度集成电路测试

8位精度200MHz流水线结构CMOS电压比较器

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微电子学 1997年第2期27卷 125-129页

作者：郭辉叶波郑增钰复旦大学专用集成电路与系统国家重点实验室

提出了一种新颖的高速ＣＭＯＳ电压比较器的电路结构，它由一个差分输入级、两级串接的ＣＭＯＳ锁存电路和两个ＣＭＯＳ倒相器所组成，并且在外部的三相不交叠时钟信号控制下进行流水线操作。整个电路根据标准的双层铝布线１．５μｍ、... 详细信息

提出了一种新颖的高速ＣＭＯＳ电压比较器的电路结构，它由一个差分输入级、两级串接的ＣＭＯＳ锁存电路和两个ＣＭＯＳ倒相器所组成，并且在外部的三相不交叠时钟信号控制下进行流水线操作。整个电路根据标准的双层铝布线１．５μｍ、ｎ阱工艺设计规则和工艺参数进行设计，版图面积为１００μｍ×８０μｍ。整个电路在５Ｖ单电源供电条件下进行具有８位精度的电压比较工作，在以最大采样频率（２００ＭＨｚ）工作时，功耗仅为１．

关键词：模/数转换器比较器 CMOS 锁存器放大器

一种适合VLSI库的Rail-to-Rail运算放大器

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固体电子学研究与进展 2002年第1期22卷 107-113页

作者：叶俊高劲松郑增钰李联复旦大学专用集成电路与系统国家重点实验室上海200433

介绍了一种适于 VLSI库单元的轨到轨 (Rail-to-Rail)运算放大器。低电压、低功耗、输入输出动态幅度达到 Rail-to-Rail的运放模块是研究的核心。文章分析了该运放模块的输入、输出级 ,并分析了 cascodedMiller频率补偿技术。芯片采用新... 详细信息

介绍了一种适于 VLSI库单元的轨到轨 (Rail-to-Rail)运算放大器。低电压、低功耗、输入输出动态幅度达到 Rail-to-Rail的运放模块是研究的核心。文章分析了该运放模块的输入、输出级 ,并分析了 cascodedMiller频率补偿技术。芯片采用新加坡特许半导体制造公司 0 .6μm N阱 CMOS工艺 ,芯片面积 0 .0 2 4mm2 。测试结果表明 :该运放模块在 3 V工作电压下直流增益 90 d B,共模输入范围 -0 .4～ 4V,输出动态范围 0～ 2 .9V,单位增益带宽 7MHz,相位裕量 70°,静态功耗仅有 0 .3 m W,特别适合作为

关键词：轨到轨运算放大器 VLSI

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一种新型的级联并行过采样∑Δ调制器结构

电子学报 2000年第2期28卷 68-71页

作者：王雪生秦巍凌燮亭郑增钰复旦大学专用集成电路与系统国家重点实验室上海200433

本文提出了一种基于时域交织技术的级联∑Δ调制器新结构 ,保留了原有时域交织结构的速度优势 ,克服了它的缺点 ,且电路简单 ,具有实用价值 .对 1- 1级联、4路并行的情况进行模拟的结果表明 :新结构比普通 2阶∑Δ调制器 ,相同时钟速率... 详细信息

本文提出了一种基于时域交织技术的级联∑Δ调制器新结构 ,保留了原有时域交织结构的速度优势 ,克服了它的缺点 ,且电路简单 ,具有实用价值 .对 1- 1级联、4路并行的情况进行模拟的结果表明 :新结构比普通 2阶∑Δ调制器 ,相同时钟速率下转换精度提高 3bit,同样精度要求下转换带宽扩大一倍 ,对各路增益失配等电路非理想因素不敏感 .

关键词：增量调制器级联时域交织技术

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部分扫描法可测性设计

半导体技术 1995年第2期11卷 35-39页

作者：陈瑜华叶波郑增钰复旦大学专用集成电路与系统国家重点实验室

对部分扫描法可测性设计进行了系统的分析，介绍了部分扫描法的最新进展，讨论了目前部分扫描法在集成电路设计中应用存在的问题，在此基础上提出了优化部分扫描可测性设计的方法。

关键词：集成电路设计可测性

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一种基于模糊逻辑的加热控制器

微电子学 1998年第1期28卷 60-63页

作者：申立坤叶波郑增钰复旦大学专用集成电路与系统国家重点实验室

设计了一种用于加热的模糊控制器。用ＶｅｒｉｌｏｇＨＤＬ语言在行为级上描述了加热器的功能，用ＦＰＧＡ验证了电路的功能，然后综合至门级，用１．２μｍ两层金属布线标准单元库进行自动布局布线直至生成版图。结果表明，采用该方法... 详细信息

设计了一种用于加热的模糊控制器。用ＶｅｒｉｌｏｇＨＤＬ语言在行为级上描述了加热器的功能，用ＦＰＧＡ验证了电路的功能，然后综合至门级，用１．２μｍ两层金属布线标准单元库进行自动布局布线直至生成版图。结果表明，采用该方法可增加设计的灵活性，缩短了设计周期。电路最高工作频率达２５ＭＨｚ，可用于高速实时控制。

关键词：专用集成电路模糊逻辑控制器 FPGA

基于MOS管PDE模型的RF电路瞬态包络仿真算法分析

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复旦学报（自然科学版） 2004年第1期43卷 10-15页

作者：杨励谭俊来金梅 Omar Wing 郑增钰复旦大学专用集成电路与系统国家重点实验室上海200433

提出了以谐波平衡技术为平台,基于RF电路中MOS晶体管PDE模型的混合域瞬态包络仿真算法,解决了将MOS晶体管的PDE模型与表征电路系统的ODE耦合在一起进行数值求解的问题,并以一个功放电路为例说明了这种仿真技术的有效性.

关键词：集成电路设计 RF电路 MOS晶体管PDE模型瞬态包络仿真谐波平衡

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一种双端USB电源开关电路的设计

微电子学 2001年第4期31卷 295-297,300页

作者：沈磊倪寅凌郑增钰复旦大学专用集成电路与系统国家重点实验室上海200433

介绍了一种用 CMOS工艺实现的双端 USB电源开关控制电路 ,着重阐述了电路内部自动进行工作电压欠压检测控制、过热和过流限制等一系列保护调整电路的工作原理及实现方法 ,并对一个用于建立内部参考电压的带隙 (Band- gap)基准源进行了... 详细信息

介绍了一种用 CMOS工艺实现的双端 USB电源开关控制电路 ,着重阐述了电路内部自动进行工作电压欠压检测控制、过热和过流限制等一系列保护调整电路的工作原理及实现方法 ,并对一个用于建立内部参考电压的带隙 (Band- gap)基准源进行了分析。在版图设计中 ,提出了一种优化的具有超低导通电阻的开关控制管拓扑结构。计算机模拟表明 ,整个设计获得了预期的结果。

关键词：天关电源专用集成电路电路设计不间断电源