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一种有效的两端线网布线方法

微电子学 1999年第1期29卷 25-29页

作者：葛海通严晓浪杭州电子工业学院CAD研究所

提出了一种基于计算几何学的面向两端线网的布线算法。对于给定的布线平面，该算法首先根据障碍情况构造了包含最短路径信息的强连接图，然后引入绕障碍长度作为参数，以决定搜索走向，算法保证能找到最短布线路径，并使其时空复杂度得... 详细信息

提出了一种基于计算几何学的面向两端线网的布线算法。对于给定的布线平面，该算法首先根据障碍情况构造了包含最短路径信息的强连接图，然后引入绕障碍长度作为参数，以决定搜索走向，算法保证能找到最短布线路径，并使其时空复杂度得到了极大的改善。

关键词：布线算法最短路径连接图计算机辅助设计

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超大规模集成电路无网格布线算法研究

电路与系统学报 2002年第4期7卷 13-16页

作者：王书江葛海通严晓浪浙江大学超大规模集成电路设计研究所浙江杭州310027

本文提出一种高性能超大规模集成电路无网格布线算法。对于给定的布线平面,算法首先生成该布线平面的非均匀网格图,然后以绕障长度为布线参数,采用优化迷宫算法完成具体的布线过程。算法保证能够找到存在的最短布线路径,并能进行变线宽... 详细信息

本文提出一种高性能超大规模集成电路无网格布线算法。对于给定的布线平面,算法首先生成该布线平面的非均匀网格图,然后以绕障长度为布线参数,采用优化迷宫算法完成具体的布线过程。算法保证能够找到存在的最短布线路径,并能进行变线宽、变线距布线,布线速度很快,效果很好。

关键词：超大规模集成电路无网格布线变线宽

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VLSI总体布线算法研究与实现

电路与系统学报 2003年第5期8卷 47-50页

作者：杨垠丹葛海通严晓浪浙江大学超大规模集成电路设计研究所浙江杭州310027

总体布线是布图设计中一个极为重要的设计环节。本文提出了基于可分离最小生成树(SMST)的优化L形直角斯坦(Steiner)树(L_RST)和优化Z_RST的算法。该算法实现上绕开计算重合度问题,以新的角度计算代价。利用基于tile的结构,实现了伪管脚(... 详细信息

总体布线是布图设计中一个极为重要的设计环节。本文提出了基于可分离最小生成树(SMST)的优化L形直角斯坦(Steiner)树(L_RST)和优化Z_RST的算法。该算法实现上绕开计算重合度问题,以新的角度计算代价。利用基于tile的结构,实现了伪管脚(pseudo pin)的分配,适用于现代多层布线需求。最后文章研究了同时考虑串扰和时延的综合性能驱动的总体布线算法改进。

关键词：总体布线可分离最小生成树直角斯坦纳树伪管脚

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面向非写分配高速缓存的一致性协议及实现

浙江大学学报（工学版） 2015年第2期49卷 351-359页

作者：修思文黄凯余慜谢天艺葛海通严晓浪浙江大学超大规模集成电路研究所浙江杭州310027 杭州中天微系统有限公司浙江杭州310027

针对现有的高速缓存一致性协议应用在基于写回、非写分配缓存的多核处理器的缺点,提出一种新颖的基于写干涉的一致性协议,并加以硬件实现.采用写干涉协议,在处理器产生写缺失操作时,可以把数据直接写到系统中其他处理器有效的该高速缓... 详细信息

针对现有的高速缓存一致性协议应用在基于写回、非写分配缓存的多核处理器的缺点,提出一种新颖的基于写干涉的一致性协议,并加以硬件实现.采用写干涉协议,在处理器产生写缺失操作时,可以把数据直接写到系统中其他处理器有效的该高速缓存行中;支持"脏数据"的延迟回写和缓存间的数据拷贝;且系统中只要存在有效的被请求的缓存行就可以提供数据,避免不必要的共享存储器访问.实验结果表明,该文提出的写干涉协议与MOESI协议相比,显著减少了对共享存储器的访问,提高了整个系统性能,同时大幅降了低动态功耗.

关键词：非写分配多核处理器高速缓存一致性协议写干涉

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基于神经网络的片上互连线电感提取法

微电子学 2002年第3期32卷 178-181页

作者：何剑春严晓浪葛海通何乐年浙江大学电气工程学院VLSI设计研究所浙江杭州310027

通过将具有自学习能力和记忆功能的神经网络应用于平行导体间的电感计算 ,结合移动窗口方法搜索作用域 ,实现片上互连寄生电感参数提取。仿真例子表明 ,此方法能够快速、有效地实现电感提取 ,可作为 VLSI互连线性能分析。

关键词：片上互连线电感提取法神经网络 VLSI 集成电路

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一种形式化验证方法:模型检验

浙江大学学报（理学版） 2006年第4期33卷 403-407页

作者：杨军葛海通郑飞君严晓浪浙江大学超大规模集成电路设计研究所浙江杭州310027

模型检验作为一种形式化验证方法,近年来在各种硬件、软件设计中得到了广泛应用.文中首先介绍了描述系统行为的Kripke结构和描述系统性质的CTL逻辑,然后介绍了模型检验中常用的两种算法:标记算法和基于固定点的算法,最后介绍了为避免内... 详细信息

模型检验作为一种形式化验证方法,近年来在各种硬件、软件设计中得到了广泛应用.文中首先介绍了描述系统行为的Kripke结构和描述系统性质的CTL逻辑,然后介绍了模型检验中常用的两种算法:标记算法和基于固定点的算法,最后介绍了为避免内存爆炸而引入的符号模型检验技术.

关键词：模型检验 Kripke结构 CTL逻辑标记固定点符号模型检验

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一种嵌入式处理器IP的硬核建模技术及实现

电路与系统学报 2009年第3期14卷 77-81页

作者：何仙娥严晓浪葛海通浙江大学超大规模集成电路设计研究所浙江杭州310027

本文介绍了嵌入式处理器IP硬核的整套建模技术,并成功应用于一款32位高性能嵌入式处理器。生成的模型能准确描述IP硬核特性,符合业界工具标准输入格式并更易于使用,而且模型以加密或接口模型的方式很好地保护了IP核的知识产权。已有两... 详细信息

本文介绍了嵌入式处理器IP硬核的整套建模技术,并成功应用于一款32位高性能嵌入式处理器。生成的模型能准确描述IP硬核特性,符合业界工具标准输入格式并更易于使用,而且模型以加密或接口模型的方式很好地保护了IP核的知识产权。已有两款使用该处理器IP的SoC系统芯片基于这些模型流片成功,验证了模型的正确性和适用性。

关键词：系统芯片 IP硬核建模技术

VLSI片上互连线电感提取技术及考虑电感效应的互连分析

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电路与系统学报 2002年第4期7卷 67-71页

作者：何剑春严晓浪何乐年葛海通浙江大学电气工程学院VLSI设计研究所浙江杭州310027

VDSM工艺下,芯片的高速、高集成度趋势使电磁耦合作用不容忽略;而电感效应的引入使VLSI设计和验证变得复杂。本文阐述了VLSI片上互连线电感提取技术现状及发展方向,对各类提取方法作了扼要比较;同时探讨了互连分析中包含电感效应时存在... 详细信息

VDSM工艺下,芯片的高速、高集成度趋势使电磁耦合作用不容忽略;而电感效应的引入使VLSI设计和验证变得复杂。本文阐述了VLSI片上互连线电感提取技术现状及发展方向,对各类提取方法作了扼要比较;同时探讨了互连分析中包含电感效应时存在的部分问题和解决办法,以期作为提高VLSI设计、分析和验证效率的有效向导。

关键词：电感效应参数提取频变寄生电感 VLSI互连线 IC 芯片

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超深亚微米芯片互连线电感提取技术及应用

浙江大学学报（工学版） 2002年第6期36卷 638-641页

作者：何剑春陆思安何乐年葛海通严晓浪浙江大学超大规模集成电路设计研究所浙江杭州310027

超深亚微米(VDSM)工艺下,集成电路的高频、高集成度趋势使互连线间电磁耦合作用不容忽略.首先回顾了典型电感提取方法及实际应用中电感阵稀疏化、模型降阶等问题;基于互连线分布RLC模型,对一类电源树的同步切换噪声问题作了分析;并介绍... 详细信息

超深亚微米(VDSM)工艺下,集成电路的高频、高集成度趋势使互连线间电磁耦合作用不容忽略.首先回顾了典型电感提取方法及实际应用中电感阵稀疏化、模型降阶等问题;基于互连线分布RLC模型,对一类电源树的同步切换噪声问题作了分析;并介绍了RL梯状电路、有效电容法等实用电感效应处理措施.一些仿真实例表明,未来高频集成电路中电感效应可严重影响部分关键互连线网性能,将成为信号完整性的重要制约因素.

关键词：超深亚微米电感提取 VLSI互连线信号完整性集成电路制造工艺芯片设计