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基于H.323协议的独立IP可视电话的设计与实现

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武汉大学学报（信息科学版） 2002年第1期27卷 89-93页

作者：方湘艳朱荣李红段汉文武汉大学多媒体网络通信工程湖北省重点实验室武汉市珞喻路129号430079

论述了独立IP可视电话实现的关键技术 ,介绍了H .32 3协议的相关内容 ,并在H .32 3协议框架的基础上提出了一种可行的独立IP可视电话的设计和实现方案。

关键词： H.323协议 IP可视电话音频编解码视频编解码嵌入式操作系统多任务

基于FPGA的PCI到ISA总线转换芯片的设计与实现

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计算机工程与应用 2006年第33期42卷 83-87页

作者：方湘艳袁由光韩威哈尔滨工程大学计算机学院哈尔滨150001 中国船舶重工集团公司第709研究所武汉430074

论文对PCI和ISA总线的原理以及接口转换的关键技术进行了阐述,提出了通过FPGA来实现PCI到ISA总线转换设计的方法。重点介绍了在PCI总线和PCI到ISA时序转换的逻辑电路中状态机的设计方法。最后分析了PCI到ISA总线转换的核心仿真时序图。

关键词： PCI总线 ISA总线 FPGA 状态机

基于FPGA技术的异步双端口RAM设计与实现

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中国集成电路 2005年第1期14卷 45-49,29页

作者：方湘艳韩威中国船舶重工集团公司第709研究所产品研发部

1.引言在高速数据采集和处理系统中,随着采样数据量的增大及信息处理任务的增加,对数据传送的要求也越来越高.在系统或模块间如果没有能够高速传送数据的接口,则在数据传送时极易造成瓶颈堵塞现象,从而影响整个系统对数据的处理能力.所... 详细信息

1.引言在高速数据采集和处理系统中,随着采样数据量的增大及信息处理任务的增加,对数据传送的要求也越来越高.在系统或模块间如果没有能够高速传送数据的接口,则在数据传送时极易造成瓶颈堵塞现象,从而影响整个系统对数据的处理能力.所以,高速并行数据接口的研制在信息处理系统中占有非常重要的地位.

关键词：双端口RAM 接口数据传送行数据高速数据采集 FPGA技术并行异步采样数据模块

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基于组间进位预测的快速进位加法器

计算机工程 2011年第23期37卷 288-290页

作者：丁宜栋刘昌明方湘艳海军计算技术研究所北京100841 中国船舶重工集团公司第709研究所武汉430074

为加快密码系统中大数加法的运算速度,提出并实现一种基于组间进位预测的快速进位加法器。将参与加法运算的大数进行分组,每个分组采用改进的超前进位技术以减少组内进位延时,组间通过进位预测完成不同进位状态下的加法运算,通过每个组... 详细信息

为加快密码系统中大数加法的运算速度,提出并实现一种基于组间进位预测的快速进位加法器。将参与加法运算的大数进行分组,每个分组采用改进的超前进位技术以减少组内进位延时,组间通过进位预测完成不同进位状态下的加法运算,通过每个组产生的进位状态判断最终结果。性能分析表明,该进位加法器实现1 024位大数加法运算的速度较快。

关键词：进位预测大数加法器超前进位分组进位加法器

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双端口RAM的IP软核的设计与实现

集成电路应用 2005年第3期22卷 54-58页

作者：方湘艳韩威中国船舶重工集团公司第709研究所武汉430079

本文通过分析双CPU系统中高速数据采集存在的问题,提出了用异步双端口RAM可同时读写访问存储器的解决方案。接着对双端口RAM的内部结构及关键技术进行了阐述,讨论了双端口RAM的IP核的设计方法,并通过可编程的FPGA进行实现。该方法将异步... 详细信息

本文通过分析双CPU系统中高速数据采集存在的问题,提出了用异步双端口RAM可同时读写访问存储器的解决方案。接着对双端口RAM的内部结构及关键技术进行了阐述,讨论了双端口RAM的IP核的设计方法,并通过可编程的FPGA进行实现。该方法将异步RAM用FPGA内部的同步Block RAM来实现,不但充分利用了FPGA的内部资源,而且减少了因信号的毛刺而产生的读写数据错误。最后对其综合仿真结果进行了分析。

关键词：双端口RAM 读写 IP软核双CPU系统 FPGA 高速数据采集仿真结果异步 IP核可编程

基于FPGA的PCI到ISA总线转换芯片的设计与实现

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基于FPGA的PCI到ISA总线转换芯片的设计与实现

2005中国通信集成电路技术与应用研讨会

作者：方湘艳韩威中国船舶重工集团公司第709研究所产品研发部中国船舶重工集团公司第709研究所产品研发部

本文对PCI和ISA总线的原理以及接口转换的关键技术进行了阐述,提出了通过FPGA来实现PCI到ISA 总线转换设计方法。重点介绍了在PCI总线和PCI到ISA时序转换的逻辑电路中状态机的设计方法。最后分析了PCI 到ISA总线转换的核心仿真时序图。

关键词： PCI总线 ISA总线 FPGA 状态机

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图形激光标刻中的分区遗传算法

光电子．激光 2017年第2期28卷 223-229页

作者：肖进胜王羿翔王朝敏刘丹方湘艳武汉大学电子信息学院湖北武汉430072 中船重工(武汉)凌久高科有限公司湖北武汉430074 中国船舶重工集团公司第七○九研究所湖北武汉430205

针对目前激光标刻系统中最短路径算法生成时间长、路径效果达不到最优的特点,提出了一种全新模式最短路径算法。首先根据图形平面分布特点,将分布位置接近的图形集中到一个区域,使所有图形划分到多个区域;其次对各个区域内图形进行路径... 详细信息

针对目前激光标刻系统中最短路径算法生成时间长、路径效果达不到最优的特点,提出了一种全新模式最短路径算法。首先根据图形平面分布特点,将分布位置接近的图形集中到一个区域,使所有图形划分到多个区域;其次对各个区域内图形进行路径优化,这样可以减少算法优化规模,提高算法效率;然后采取最优方式对各区域排列顺序进行调整,要求各区域内之间的总体距离最短;最后所有图形根据调整后的排列顺序依次输出,得到优化路径。实验结果证明,相比原有算法,本文算法在生成时间上提升近97%,路径效果提升近5%,在算法生成时间和路径效果上具有明显优势,更适合应用于激光标刻系统。

关键词：激光标刻最短路径图形分区

基于FPGA技术的异步双端口RAM设计与实现

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基于FPGA技术的异步双端口RAM设计与实现

中国通信集成电路技术与应用研讨会

作者：方湘艳韩威中国船舶重工集团公司第709研究所产品研发部中国船舶重工集团公司第709研究所产品研发部

本文通过分析双CPU系统中高速数据采集存在的问题,提出了用异步双端口RAM可同时读写访问存储器的解决方案。接着对异步双端口RAM的内部结构及关键技术进行了阐述,介绍了通过FPGA来实现异步双端口RAM功能的一种方法。该方法将异步RAM用F... 详细信息

本文通过分析双CPU系统中高速数据采集存在的问题,提出了用异步双端口RAM可同时读写访问存储器的解决方案。接着对异步双端口RAM的内部结构及关键技术进行了阐述,介绍了通过FPGA来实现异步双端口RAM功能的一种方法。该方法将异步RAM用FPGA内部的同步Block RAM来实现,不但充分利用了FPGA的内部资源,而且减少了因信号的毛刺而产生的读写数据错误.并对其综合仿真结果进行了分析。

关键词：异步双端口 RAM 竞争 FPGA Block RAM

来源： cnki会议评论

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一种新的IP仿真测试平台的实现

中国集成电路 2007年第9期16卷 58-62页

作者：方湘艳韩威中国船舶重工集团公司第709研究所

针对传统的IP测试方法存在的问题和缺陷,本文提出了个人PCI机进行联机测试的IP验证方法。该方法将IP仿真测试硬件平台通过PCI接口与个人工作PC机进行数据传输,并充分利用PC机的资源和第三方仿真工具软件实现IP测试过程中数据、波形的存... 详细信息

针对传统的IP测试方法存在的问题和缺陷,本文提出了个人PCI机进行联机测试的IP验证方法。该方法将IP仿真测试硬件平台通过PCI接口与个人工作PC机进行数据传输,并充分利用PC机的资源和第三方仿真工具软件实现IP测试过程中数据、波形的存储、分析等功能,降低了测试成本,解决了大数据量测试的问题。

关键词： IP测试 PC机 PCI总线