5G LDPC码译码器实现
On the Implementation of 5G LDPC Decoder作者机构：中国电子科技集团公司第五十四研究所石家庄050080
出 版 物：《电子与信息学报》 (Journal of Electronics & Information Technology)
年 卷 期：2021年第43卷第4期
页 面：1112-1119页
核心收录：
学科分类：0810[工学-信息与通信工程] 0808[工学-电气工程] 0809[工学-电子科学与技术（可授工学、理学学位）] 08[工学]
摘 要：该文介绍了5G标准中LDPC码的特点,比较分析了各种译码算法的性能,提出了译码器实现的总体架构:将译码器分为高速译码器和低信噪比译码器。高速译码器适用于码率高、吞吐率要求高的情形,为译码器的主体;低信噪比译码器主要针对低码率、低信噪比下的高性能译码,处理一些极限情形下的通信,对吞吐率要求不高。分别对高速译码器和低信噪比译码器进行了设计实践,给出了FPGA综合结果和吞吐率分析结果。
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